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参数资料
| 型号： | X9470V24I |
| 厂商： | Intersil |
| 文件页数： | 8/24页 |
| 文件大小： | 0K |
| 描述： | IC BIAS CTRLR RF PA 24-TSSOP |
| 标准包装： | 62 |
| RF 型： | CDMA，GSM，EDGE |
| 封装/外壳： | 24-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 24-TSSOP 裸露焊盘 |
X9470
AC SPECIFICATIONS
Symbol
f SCL
SCL Clock Frequency
Parameter
Min.
0
Max.
400
Unit
kHz
t IN
(10)
Pulse width Suppression Time at inputs
50
ns
t AA
(10)
SCL LOW to SDA Data Out Valid
0.1
0.9
μs
t BUF
(10)
Time the bus must be free before a new transmission can start
1.3
μs
t LOW
t HIGH
t SU:STA
t HD:STA
t SU:DAT
t HD:DAT
t SU:STO
Clock LOW Time
Clock HIGH Time
Start Condition Setup Time
Start Condition Hold Time
Data In Setup Time
Data In Hold Time
Stop Condition Setup Time
1.3
0.6
0.6
0.6
200
200
0.6
μs
μs
μs
μs
ns
ns
μs
t DH
(10)
Data Output Hold Time
50
ns
t R
(10)
SDA and SCL Rise Time
20
+.1Cb (12)
300
ns
t F(10)
Cb (10)
SDA and SCL Fall Time
Capacitive load for each bus line
20 +.1Cb (12)
300
400
ns
pF
Note:
(12) Cb = total capacitance of one bus line in pF.
TIMING DIAGRAMS
Bus Timing
SCL
t F
t SU:DAT
t HIGH
t LOW
t R
SDA IN
t SU:ST
t HD:STA
t HD:DAT
t AA
t DH
t BUF
t SU:STO
SDA OUT
Write Cycle Timing
SCL
SDA
8th Bit of Last Byte
ACK
t WC
8
Stop
Condition
Start
Condition
FN8204.0
March 8, 2005
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PDF描述 |
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参数描述 |
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