参数资料
| 型号： | XC3S50AN-4TQ144I |
| 厂商： | Xilinx Inc |
| 文件页数： | 86/123页 |
| 文件大小： | 0K |
| 描述： | IC FPGA SPARTAN 3AN 144TQFP |
| 标准包装： | 60 |
| 系列： | Spartan®-3AN |
| LAB/CLB数： | 176 |
| 逻辑元件/单元数： | 1584 |
| RAM 位总计： | 55296 |
| 输入/输出数： | 108 |
| 门数： | 50000 |
| 电源电压： | 1.14 V ~ 1.26 V |
| 安装类型： | 表面贴装 |
| 工作温度： | -40°C ~ 100°C |
| 封装/外壳： | 144-LQFP |
| 供应商设备封装： | 144-TQFP（20x20） |
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Spartan-3AN FPGA Family: DC and Switching Characteristics
DS557 (v4.1) April 1, 2011
Product Specification
65
External Serial Peripheral Interface (SPI) Configuration Timing
X-Ref Target - Figure 16
Figure 16: Waveforms for External Serial Peripheral Interface (SPI) Configuration
Table 57: Timing for External Serial Peripheral Interface (SPI) Configuration Mode
Symbol
Description
Minimum
Maximum
Units
TCCLK1
Initial CCLK clock period
See Table 51
TCCLKn
CCLK clock period after FPGA loads ConfigRate bitstream option setting
See Table 51
TMINIT
Setup time on VS[2:0] variant-select pins and M[2:0] mode pins before the
rising edge of INIT_B
50
–ns
TINITM
Hold time on VS[2:0] variant-select pins and M[2:0] mode pins after the
rising edge of INIT_B
0
–ns
TCCO
MOSI output valid delay after CCLK falling clock edge
See Table 55
TDCC
Setup time on the DIN data input before CCLK rising clock edge
See Table 55
TCCD
Hold time on the DIN data input after CCLK rising clock edge
See Table 55
T
DH
T
DSU
Command
(msb)
T
V
T
CSS
<1:1:1>
INIT_B
M[2:0]
T
MINIT
T
INITM
DIN
CCLK
(Input)
T
CCLK
n
T
CCLK1
VS[2:0]
(Input)
New ConfigRate active
Mode input pins M[2:0] and variant select input pins VS[2:0] are sampled when INIT_B
goes High. After this point, input values do not matter until DONE goes High, at which
point these pins become user-I/O pins.
<0:0:1>
Pin initially pulled High by internal pull-up resistor if PUDC_B input is Low.
Pin initially high-impedance (Hi-Z) if PUDC_B input is High. External pull-up resistor required on CSO_B.
T
CCLK1
T
MCCL
n
T
MCCH
n
(Input)
Data
CSO_B
MOSI
T
CCO
T
MCCL1
T
MCCH1
T
DCC
T
CCD
(Input)
PROG_B
PUDC_B
(Input)
PUDC_B must be stable before INIT_B goes High and constant throughout the configuration process.
DS529-3_06_102506
(Open-Drain)
Shaded values indicate specifications on attached SPI Flash PROM.
Command
(msb-1)
相关PDF资料 |
PDF描述 |
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| 24LC08BT-E/MNY | IC EEPROM 8KBIT 400KHZ 8TDFN |
相关代理商/技术参数 |
参数描述 |
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