参数资料
| 型号： | XRT75R12IB |
| 厂商： | Exar Corporation |
| 文件页数： | 47/90页 |
| 文件大小： | 0K |
| 描述： | IC LIU E3/DS3/STS-1 12CH 420TBGA |
| 标准包装： | 40 |
| 类型： | 线路接口装置（LIU） |
| 驱动器/接收器数： | 12/12 |
| 规程： | DS3，E3，STS-1 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 420-LBGA 裸露焊盘 |
| 供应商设备封装： | 420-TBGA（35x35） |
| 包装： | 托盘 |
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XRT75R12
48
REV. 1.0.4
TWELVE CHANNEL E3/DS3/STS-1 LINE INTERFACE UNIT WITH JITTER ATTENUATOR
NOTE: 1. This timing parameter is based on the frequency of the synchronous clock (PCLK). To determine the access
time, use the following formula: (PCLKperiod * 2) + 5ns
7.3
Register Map
FIGURE 36. SYNCHRONOUS P INTERFACE SIGNALS DURING PROGRAMMED I/O READ AND WRITE OPERATIONS
TABLE 16: SYNCHRONOUS TIMING SPECIFICATIONS
SYMBOL
PARAMETER
MIN
MAX
UNITS
t0
Valid Address to CS Falling Edge
0
-
ns
t1
CS Falling Edge to RD Assert
0
-
ns
t2
RD Assert to RDY Assert
-
35
ns, see note 1
NA
RD Pulse Width (t2)
40
-
ns
t3
CS Falling Edge to WR Assert
0
-
ns
t4
WR Assert to RDY Assert
-
35
ns, see note 1
NA
WR Pulse Width (t4)
40
-
ns
PCLK Period
15
ns
PCLK Duty Cycle
PCLK "High/Low" time
TABLE 17: COMMAND REGISTER ADDRESS MAP, WITHIN THE XRT75R12
ADDRESS
(HEX)
COMMAND REGISTER
(DECIMAL)
LABEL
TYPE
REGISTER NAME
0x00
CR0
APST
R/W
APS Transmit Redundancy Control Register 0-5
CHANNEL 0 CONTROL REGISTERS
0x01
CR1
IER0
R/W
Source Level Interrupt Enable Register - Ch 0
0x02
CR2
ISR0
RUR
Source Level Interrupt Status Register Ch 0
CS
Addr[7:0]
D[7:0]
RD
WR
RDY
Valid Data for Readback
Data Available to Write Into the LIU
READ OPERATION
WRITE OPERATION
t
0
t
0
t
1
t
4
t
2
t
3
Valid Address
PCLK
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PDF描述 |
|---|---|
| ISL267450AIUZ-T | IC INTERFACE |
| MS3116P16-8P | CONN PLUG 8POS STRAIGHT W/PINS |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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| XRT75VL00D | 制造商:EXAR 制造商全称:EXAR 功能描述:E3/DS3/STS-1 LINE INTERFACE UNIT WITH SONET DESYNCHRONIZER |
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