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参数资料
| 型号： | A3942KLGTR-T |
| 厂商： | Allegro Microsystems Inc |
| 文件页数： | 9/20页 |
| 文件大小： | 0K |
| 描述： | IC GATE DVR QUAD HISIDE 38-TSSOP |
| 标准包装： | 8,000 |
| 配置： | 高端 |
| 输入类型： | SPI |
| 延迟时间： | 600ns |
| 电流 - 峰： | 15mA |
| 配置数： | 4 |
| 输出数： | 4 |
| 电源电压： | 4.5 V ~ 60 V |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 38-TFSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 38-TSSOP |
| 包装： | 带卷 (TR) |
A3942
Input SettingsTiming Chart
INx
Timer is running for
turn-on blank time
Quad High-Side Gate Driver
for Automotive Applications
Timer is running for
turn-off blank time
I Gx
V GSx
t p(on)
Gate begins
to charge
V GS = V TH
Set blank time to expire
after V Sx nears V BB
t p(off)
Set blank time to expire
after V Sx nears 0 V
V BB
V Sx
Fault Logic Table
Circle d data cells indicate default settings, X indicates “don’t care”, Z indicates high impedance state
Causes
Effects
Channel-Specific
Mode of Operation
1
1
1
1
1
1
1
1
1
0
0
1
1
1
X
X
X
X
X
X
0
0
0
0
0
0
0
0
1
X
0
0
0
0
0
0
0
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X
0
0
0
X
0
0
1
X
X
X
0
0
0
X
0
1
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X
X
X
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0
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1
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X
X
X
X
X
X
1
X
0
0
X
X
X
0
0
1
0
X
X
X
X
X
X
1
1
0
1
0
0
0
0
0
0
0
INx
INx
INx
0
0
0
0
0
Z
1
1
1
1
1
1
1
UV
1
0
1
1
1
1
1
1
1
1
1
0
Gates actively pulled low
Normal operation
FAULTZ issued but A3942 fully operational
Normal operation, OL and STB masked
STG cannot be masked
STB
OL
VCP UVLO disables outputs only
VDD UVLO disables outputs only
Sleep mode
Allegro MicroSystems, LLC
115 Northeast Cutoff
Worcester, Massachusetts 01615-0036 U.S.A.
1.508.853.5000; www.allegromicro.com
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相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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