参数资料
| 型号： | AD73322LYRZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 37/48页 |
| 文件大小： | 0K |
| 描述： | IC ANALOG FRONT END DUAL 28-SOIC |
| 标准包装： | 27 |
| 位数： | 16 |
| 通道数： | 4 |
| 功率（瓦特）： | 73mW |
| 电压 - 电源，模拟： | 2.7 V ~ 5.5 V |
| 电压 - 电源，数字： | 2.7 V ~ 5.5 V |
| 封装/外壳： | 28-SOIC（0.295"，7.50mm 宽） |
| 供应商设备封装： | 28-SOIC W |
| 包装： | 管件 |
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AD73322L
Rev. A | Page 42 of 48
Table 27. Data Mode Operation
Step
DSP Tx
AD73322L Channel 1
AD73322L Channel 2
DSPRx
1
Control Word CRB–CH2 ->
Data-word OUTPUT CH1 ->
Data-word OUTPUT CH2 ->
1000100100001011
0000000000000000
2
Control Word CRB–CH1 ->
Control Word CRB–CH2 ->
Data-word OUTPUT CH1 ->
Data-word OUTPUT CH2
1000000100001011
1000100100001011
0000000000000000
3
Control Word CRB–CH1
Control Word CRB–CH2
Data-word OUTPUT CH1
1000000100001011
0000000000000000
At this time, Control Register B of both Channel 1 and Channel 2 are updated.
4
Control Word CRC–CH2 ->
Data-word OUTPUT CH1 ->
Data-word OUTPUT CH2 ->
1000101011111001
0000000000000000
5
Control Word CRC–CH1 ->
Control Word CRC–CH2 ->
Data-word OUTPUT CH1 ->
Data-word OUTPUT CH2
1000001011111001
1000101011111001
0000000000000000
6
Control Word CRC–CH1
Control Word CRC–CH2
Data-word OUTPUT CH1
1000001011111001
0000000000000000
At this time, Control Register C of both Channel 1 and Channel 2 are updated.
7
Control Word CRA–CH2 ->
Data-word OUTPUT CH1 ->
Data-word OUTPUT CH2 ->
1000100000010001
0000000000000000
8
Control Word CRA–CH1 ->
Control Word CRA–CH2 ->
Data-word OUTPUT CH1 ->
Data-word OUTPUT CH2
1000000000010001
1000100000010001
0000000000000000
9
Control Word CRA–CH1
Control Word CRA–CH2
Data-word OUTPUT CH1
1000000000010001
0000000000000000
At this time, Control Register A of both Channel 1 and Channel 2 are updated.
10
DAC WORD CH 2 ->
ADC Result CH1 ->
ADC Result CH2 ->
0111111111111111
Unknown Data
11
DAC WORD CH 1 ->
DAC Word CH 2 ->
ADC Result CH1 ->
ADC Result CH2
1000000000000000
0111111111111111
Unknown Data
12
DAC Word CH 1
DAC Word CH 2
ADC Result CH1
1000000000000000
0111111111111111
Unknown Data
At this time, the DAC of both Channel 1 and Channel 2 is updated and the ADC of both Channel 1 and Channel 2 has been read.
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