参数资料
| 型号： | AD9148BBPZRL |
| 厂商： | Analog Devices Inc |
| 文件页数： | 25/72页 |
| 文件大小： | 0K |
| 描述： | IC DAC 16BIT SPI/SRL 196BGA |
| 标准包装： | 1,500 |
| 系列： | TxDAC+® |
| 设置时间： | 20ns |
| 位数： | 16 |
| 数据接口： | 串行，SPI? |
| 转换器数目： | 4 |
| 电压电源： | 单电源 |
| 功率耗散（最大）： | 2.67W |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 196-LFBGA 裸露焊盘 |
| 供应商设备封装： | 196-BGA |
| 包装： | 带卷 (TR) |
| 输出数目和类型： | 4 电流，单极 |
| 采样率（每秒）： | 1G |
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Data Sheet
AD9148
Rev. B | Page 31 of 72
Register Name
Addr
(Hex)
Bit
Name
Function
Default
FIFO Status Port A
18
7:0
FIFO Level
Thermometer encoded measure of the FIFO level.
Read-
only
FIFO Status/
Control Port B
19
7
FIFO Warning 1
FIFO read and write pointers within ±1.
Read-
only
6
FIFO Warning 2
FIFO read and write pointers within ±2.
Read-
only
5
FIFO reset aligned
FIFO read and write pointers aligned after chip reset.
Read-
only
4
FIFO SPI align
acknowledge
FIFO read and write pointers aligned after SPI driven FIFO
reset.
Read-
only
3
FIFO SPI align
requesting
Request FIFO read and write pointers alignment via SPI.
0
2:0
FIFO phase offset
FIFO read and write pointer phase offset from optimal
phase following FIFO reset.
000
000 = 0 offset from optimal phase.
…
111 = 7 offset from optimal phase.
The optimal value is 0.
FIFO Status Port B
1A
7:0
FIFO level
Thermometer encoded measure of the FIFO level.
Read-
only
HB1 Control
1C
7
Enable pre mod
Enable fS/2 modulation stage that precedes Stage 1
interpolation filter.
0
6
Bypass sinc-1
Sinc-1 filter bypass.
1
2:1
HB1[1:0]
Modulation mode for first stage interpolation filter
(fHB1 = 2 × fIN1).
00
00 = input signal modulated by dc. Filter pass band is
from 0.2 to +0.2 of fHB1.
01 = input signal modulated by dc. Filter pass band is
from 0.05 to 0.45 of fHB1.
10 = input signal modulated by fHB1/2. Filter pass band is
from 0.3 to 0.7 of fHB1.
11 = input signal modulated by fHB1/2. Filter pass band is
from 0.55 to 0.95 of fHB1.
0
Bypass HB1
First stage interpolation filter bypass.
0
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