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参数资料
| 型号： | AD9522-0/PCBZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 17/84页 |
| 文件大小： | 0K |
| 描述： | BOARD EVAL FOR AD9522-0 CLK GEN |
| 设计资源： | AD9522 Eval Board Schematic AD9522 BOM |
| 标准包装： | 1 |
| 主要目的： | 计时，时钟发生器 |
| 嵌入式： | 否 |
| 已用 IC / 零件： | AD9522-0 |
| 主要属性： | 12 LVDS/24 CMOS 输出，2.8 GHz VCO |
| 次要属性： | I²C & SPI 接口 |
| 已供物品： | 板 |
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AD9522-0
Rev. 0 | Page 24 of 84
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10
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100
100M
1M
10M
100k
10k
PH
A
S
E
N
O
ISE
(
d
B
c/
H
z)
FREQUENCY (Hz)
07
21
9-
1
32
Figure 30. Additive (Residual) Phase Noise,
CLK-to-CMOS @ 250 MHz, Divide-by-4
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1M
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100k
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PH
A
S
E
N
O
ISE
(
d
B
c/
H
z)
FREQUENCY (Hz)
07
21
9-
0
33
Figure 31. Phase Noise (Absolute) Clock Generation; Internal VCO @
2580 MHz; PFD = 15.36 MHz; LBW = 40 kHz; LVDS Output = 122.88 MHz
–80
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1k
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10k
PH
A
S
E
N
O
ISE
(
d
B
c/
H
z)
FREQUENCY (Hz)
INTEGRATED RMS JITTER (12kHz TO 20MHz): 617fs
INTEGRATED RMS JITTER (20kHz TO 80MHz): 450fs (EXTRAPOLATED)
07
21
9-
0
34
Figure 32. Phase Noise (Absolute) Clock Cleanup; Internal VCO @ 2799 MHz;
PFD = 120 kHz; LBW = 1.92 kHz; LVDS Output = 155.52 MHz
1k
100M
1M
10M
100k
10k
PH
A
S
E
N
O
ISE
(
d
B
c/
H
z)
FREQUENCY (Hz)
–80
–90
–100
–110
–120
–130
–140
–150
–160
INTEGRATED RMS JITTER (12kHz TO 20MHz): 146fs
07
21
9-
1
35
Figure 33. Phase Noise (Absolute), External VCXO (Toyocom TCO-2112)
@ 245.76 MHz; PFD = 15.36 MHz; LBW = 250 Hz; LVDS Output = 245.76 MHz
C2
62pF
C3
33pF
C1
240nF
C12
220nF
BYPASS
CAPACITOR
FOR LDO
R1
820
R2
390
LF
CP
BYPASS
07
21
9-
2
34
Figure 34. PLL Loop Filter Used for Clock Generation Plot (See Figure 31)
C2
1.5nF
C3
2.2nF
C1
4.7F
C12
220nF
BYPASS
CAPACITOR
FOR LDO
R1
2.1k
R2
3k
LF
CP
BYPASS
07
21
9-
2
35
Figure 35. PLL Loop Filter Used for Clock Cleanup Plot (See Figure 32)
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PDF描述 |
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参数描述 |
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| AD9522-2 | 制造商:AD 制造商全称:Analog Devices 功能描述:12 LVDS/24 CMOS Output Clock Generator with Integrated 2.2 GHz VCO |
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