参数资料
型号: AD9522-0/PCBZ
厂商: Analog Devices Inc
文件页数: 52/84页
文件大小: 0K
描述: BOARD EVAL FOR AD9522-0 CLK GEN
设计资源: AD9522 Eval Board Schematic
AD9522 BOM
标准包装: 1
主要目的: 计时,时钟发生器
嵌入式:
已用 IC / 零件: AD9522-0
主要属性: 12 LVDS/24 CMOS 输出,2.8 GHz VCO
次要属性: I²C & SPI 接口
已供物品:
AD9522-0
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CS
SCLK
SDIO
tHIGH
tLOW
tCLK
tS
tDS
tDH
tC
BIT N
BIT N + 1
0
72
19
-0
43
Figure 69. Serial Control Port Timing—Write
Table 45. Serial Control Port Timing
Parameter
Description
tDS
Setup time between data and rising edge of SCLK
tDH
Hold time between data and rising edge of SCLK
tCLK
Period of the clock
Setup time between the CS falling edge and SCLK rising edge (start of communication cycle)
tS
Setup time between the SCLK rising edge and CS rising edge (end of communication cycle)
tC
tHIGH
Minimum period that SCLK should be in a logic high state
tLOW
Minimum period that SCLK should be in a logic low state
tDV
SCLK to valid SDIO and SDO (see Figure 67)
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