参数资料
| 型号： | AD9995KCPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 7/60页 |
| 文件大小： | 0K |
| 描述： | IC CCD SIGNAL PROCESSOR 56-LFCSP |
| 标准包装： | 1 |
| 类型： | CCD 信号处理器，12 位 |
| 输入类型： | 逻辑 |
| 输出类型： | 逻辑 |
| 接口： | 3 线串口 |
| 电流 - 电源： | 30mA |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 56-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 56-LFCSP-VQ（8x8） |
| 包装： | 托盘 |
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AD9995
–15–
HORIZONTAL TIMING SEQUENCE EXAMPLE
Figure 13 shows an example CCD layout.The horizontal register
contains 28 dummy pixels, which will occur on each line clocked
from the CCD. In the vertical direction, there are 10 optical
black (OB) lines at the front of the readout and two at the back
of the readout.The horizontal direction has four OB pixels in the
front and 48 in the back.
Figure 14 shows the basic sequence layout to be used during the
effective pixel readout.The 48 OB pixels at the end of each line
are used for the CLPOB signals. PBLK is optional and is often
used to blank the digital outputs during the noneffective CCD
pixels. HBLK is used during the vertical shift interval.
The HBLK, CLPOB, and PBLK parameters are programmed in
the V-sequence registers.
More elaborate clamping schemes may be used, such as adding
in a separate sequence to clamp during the entire shield OB lines.
This requires configuring a separate V-sequence for reading out
the OB lines.
V
H
HORIZONTAL CCD REGISTER
EFFECTIVE IMAGE AREA
28 DUMMY PIXELS
48 OB PIXELS
4 OB PIXELS
10 VERTICAL OB LINES
2 VERTICAL OB LINES
Figure 13. Example CCD Configuration
VERTICAL SHIFT
VERT SHIFT
CCDIN
SHP
SHD
H1/H3
H2/H
HBLK
PBLK
CLPOB
OPTICALBLACK
DUMMY
EFFECTIVE PIXELS
OB
OPTICAL BLACK
HD
Figure 14. Horizontal Sequence Example
REV. 0
OBSOLETE
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参数描述 |
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