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参数资料
| 型号： | ADP1823ACPZ-R7 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 3/32页 |
| 文件大小： | 0K |
| 描述： | IC REG CTRLR BUCK PWM VM 32LFCSP |
| 标准包装： | 1 |
| PWM 型： | 电压模式 |
| 输出数： | 2 |
| 频率 - 最大： | 720kHz |
| 占空比： | 90% |
| 电源电压： | 3.7 V ~ 20 V |
| 降压： | 是 |
| 升压： | 无 |
| 回扫： | 无 |
| 反相： | 无 |
| 倍增器： | 无 |
| 除法器： | 无 |
| Cuk： | 无 |
| 隔离： | 无 |
| 工作温度： | -40°C ~ 125°C |
| 封装/外壳： | 32-VFQFN 裸露焊盘，CSP |
| 包装： | 标准包装 |
| 产品目录页面： | 791 (CN2011-ZH PDF) |
| 其它名称： | ADP1823ACPZ-R7DKR |
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ADP1823
SPECIFICATIONS
IN = 12 V, ENx = FREQ = PV = VREG = 5 V, SYNC = GND, T J = ?40°C to +125°C, unless otherwise specified. All limits at temperature
extremes are guaranteed via correlation using standard statistical quality control (SQC). Typical values are at T A = 25°C.
Table 1.
Parameter
Conditions
Min
Typ
Max
Unit
POWER SUPPLY
IN Input Voltage
IN Quiescent Current
IN Shutdown Current
PV = VREG (using internal regulator)
IN = PV = VREG (not using internal regulator)
Not switching, I VREG = 0 mA
EN1 = EN2 = GND
5.5
3.7
1.5
10
20
5.5
3
20
V
V
mA
μA
VREG Undervoltage Lockout Threshold
VREG rising
2.4
2.7
2.9
V
VREG Undervoltage Lockout Hysteresis
ERROR AMPLIFIER
0.125
V
FB1, FB2 Regulation Voltage
T A = 25°C, TRK1, TRK2 > 700 mV
T J = 0°C to 85°C, TRK1, TRK2 > 700 mV
T J = ?40°C to +125°C, TRK1, TRK2 > 700 mV
T J = 0°C to 70°C, TRK1, TRK2 > 700 mV
597
591
588
595
600
603
609
612
605
mV
mV
mV
mV
FB1, FB2 Input Bias Current
Open-Loop Voltage Gain
Gain-Bandwidth Product
COMP1, COMP2 Sink Current
COMP1, COMP2 Source Current
COMP1, COMP2 Clamp High Voltage
COMP1, COMP2 Clamp Low Voltage
LINEAR REGULATOR
70
20
600
120
2.4
0.75
100
nA
dB
MHz
μA
μA
V
V
VREG Output Voltage
T A = 25°C, I VREG = 20 mA
IN = 7 V to 20 V, I VREG = 0 mA to 100 mA,
4.85
4.75
5.0
5.0
5.15
5.25
V
V
T A = ?40°C to +85°C
VREG Load Regulation
VREG Line Regulation
VREG Current Limit
I VREG = 0 mA to 100 mA, IN = 12 V
IN = 7 V to 20 V, I VREG = 20 mA
VREG = 4 V
?40
1
220
mV
mV
mA
VREG Short-Circuit Current
IN to VREG Dropout Voltage
VREG < 0.5 V
I VREG = 100 mA, IN < 5 V
50
140
0.7
200
1.4
mA
V
VREG Minimum Output Capacitance
PWM CONTROLLER
1
μF
PWM Ramp Voltage Peak
SYNC = GND
1.3
V
DH1, DH2 Maximum Duty Cycle
FREQ = GND (300 kHz)
85
90
%
DH1, DH2 Minimum Duty Cycle
FREQ = GND (300 kHz)
1
3
%
SOFT START
SS1, SS2 Pull-Up Resistance
SS1, SS2 Pull-Down Resistance
SS1, SS2 to FB1, FB2 Offset Voltage
SS1, SS2 Pull-Up Voltage
SS1, SS2 = GND
SS1, SS2 = 0.6 V
SS1, SS2 = 0 mV to 500 mV
90
6
?45
0.8
kΩ
kΩ
mV
V
TRACKING
TRK1, TRK2 Common-Mode Input Voltage Range
0
600
mV
TRK1, TRK2 to FB1, FB2 Offset Voltage
TRK1, TRK2 Input Bias Current
TRK1, TRK2 = 0 mV to 500 mV
?5
+5
100
mV
nA
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