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参数资料
| 型号： | ADSP-21478KBCZ-3A |
| 厂商： | Analog Devices Inc |
| 文件页数： | 26/76页 |
| 文件大小： | 0K |
| 描述： | IC DSP SHARK 300MHZ 196CSPBGA |
| 标准包装： | 1 |
| 系列： | SHARC® |
| 类型： | 浮点 |
| 接口： | DAI，DPI，EBI/EMI，I²C，SPI，SPORT，UART/USART |
| 时钟速率： | 300MHz |
| 非易失内存： | ROM（4Mb） |
| 芯片上RAM： | 3Mb |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 1.30V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 196-LFBGA，CSPBGA |
| 供应商设备封装： | 196-CSPBGA（12x12） |
| 包装： | 托盘 |
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Rev. C
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July 2013
Timer WDTH_CAP Timing
The following timing specification applies to timer0 and timer1,
and in WDTH_CAP (pulse width count and capture) mode.
Timer signals are routed to the DPI_P14–1 pins through the
SRU. Therefore, the timing specification provided below is valid
at the DPI_P14–1 pins.
Watchdog Timer Timing
Table 26. Timer Width Capture Timing
Parameter
Min
Max
Unit
Timing Requirement
tPWI
Timer Pulse Width
2 × tPCLK
2 × (231 – 1) × tPCLK
ns
Figure 14. Timer Width Capture Timing
TIMER
CAPTURE
INPUTS
tPWI
Table 27. Watchdog Timer Timing
Parameter
Min
Max
Unit
Timing Requirement
tWDTCLKPER
100
1000
ns
Switching Characteristics
tRST
WDT Clock Rising Edge to Watchdog Timer
RESET Falling Edge
37.6
ns
tRSTPW
Reset Pulse Width
64 × tWDTCLKPER
1
ns
1 When the internal oscillator is used, the 1/tWDTCLKPER varies from 1.5 MHz to 2.5 MHz and the WDT_CLKIN pin should be pulled low.
Figure 15. Watchdog Timer Timing
WDT_CLKIN
WDTRSTO
tWDTCLKPER
tRST
tRSTPW
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PDF描述 |
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参数描述 |
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