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参数资料
| 型号： | ADSP-BF542KBCZ-6A |
| 厂商： | Analog Devices Inc |
| 文件页数： | 54/100页 |
| 文件大小： | 0K |
| 描述： | IC DSP 16BIT 600MHZ 400CSBGA |
| 标准包装： | 1 |
| 系列： | Blackfin® |
| 类型： | 定点 |
| 接口： | CAN，SPI，SSP，TWI，UART，USB |
| 时钟速率： | 600MHz |
| 非易失内存： | 外部 |
| 芯片上RAM： | 132kB |
| 电压 - 输入/输出： | 2.50V，3.30V |
| 电压 - 核心： | 1.25V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 400-LFBGA，CSPBGA |
| 供应商设备封装： | 400-CSPBGA（17x17） |
| 包装： | 托盘 |
| 配用： | ADZS-BF548-EZLITE-ND - KIT EZLITE ADZS-BF548 |
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ADSP-BF542/ADSP-BF544/ADSP-BF547/ADSP-BF548/ADSP-BF549
Rev. C
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February 2010
Synchronous Burst AC Timing
Table 38 and Figure 28 on Page 57 describe Synchronous Burst
AC operations.
Table 38. Synchronous Burst AC Timing
Parameter
Min
Max
Unit
Timing Requirements
tNDS
DATA15-0 Setup Before NR_CLK
4.0
ns
tNDH
DATA15-0 Hold After NR_CLK
2.0
ns
tNWS
WAIT Setup Before NR_CLK
8.0
ns
tNWH
WAIT Hold After NR_CLK
0.0
ns
Switching Characteristics
tNDO
AMSx, ABE1-0, ADDR19-1, NR_ADV, NR_OE Output Delay After NR_CLK
6.0
ns
tNHO
ABE1-0, ADDR19-1 Output Hold After NR_CLK
–3.0
ns
Figure 28. Synchronous Burst AC Interface Timing
tNDO
tNDO
tNDO
tNWS
tNWH
tNDO
tNHO
tNDH
tNDH
tNDS
tNDS
tNDO
tNHO
Dn
Dn+1
Dn+2
Dn+3
AMSx
NR_CLK
ABE1-0
ADDR19-1
DATA15-0
NR_ADV
NR_OE
WAIT
NOTE: NR_CLK dotted line represents a free running version of NR_CLK that is not visible on the NR_CLK pin.
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