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参数资料
| 型号： | AGLN010V5-UC36 |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 260 CLBS, 10000 GATES, 250 MHz, PBGA36 |
| 封装： | 4 X 4 MM, 0.8 MM HEIGHT, 0.4 MM PITCH, UC-36 |
| 文件页数： | 84/140页 |
| 文件大小： | 4325K |
| 代理商： | AGLN010V5-UC36 |
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IGLOO nano DC and Switching Characteristics
2- 34
R e v i sio n 1 0
Applies to 1.2 V DC Core Voltage
Table 2-49 2.5 LVCMOS Low Slew – Applies to 1.2 V DC Core Voltage
Commercial-Case Conditions: TJ = 70°C, Worst-Case VCC = 1.14 V, Worst-Case VCCI = 2.3 V
Drive Strength
Speed Grade
tDOUT
tDP
tDIN
tPY
tPYS
tEOUT
tZL
tZH
tLZ
tHZ
Units
2 mA
STD
1.55
4.61
0.26
1.21
1.39
1.10
4.55
4.61
2.15
2.43
ns
4 mA
STD
1.55
4.61
0.26
1.21
1.39
1.10
4.55
4.61
2.15
2.43
ns
6 mA
STD
1.55
3.86
0.26
1.21
1.39
1.10
3.82
3.86
2.41
2.89
ns
8 mA
STD
1.55
3.86
0.26
1.21
1.39
1.10
3.82
3.86
2.41
2.89
ns
Note:
For specific junction temperature and voltage supply levels, refer to Table 2-6 on page 2-6 for derating values.
Table 2-50 2.5 V LVCMOS High Slew – Applies to 1.2 V DC Core Voltage
Commercial-Case Conditions: TJ = 70°C, Worst-Case VCC = 1.14 V, Worst-Case VCCI = 2.3 V
Drive Strength
Speed Grade
tDOUT
tDP
tDIN
tPY
tPYS
tEOUT
tZL
tZH
tLZ
tHZ
Units
2 mA
STD
1.55
2.68
0.26
1.21
1.39
1.10
2.72
2.54
2.15
2.51
ns
4 mA
STD
1.55
2.68
0.26
1.21
1.39
1.10
2.72
2.54
2.15
2.51
ns
6 mA
STD
1.55
2.30
0.26
1.21
1.39
1.10
2.33
2.04
2.41
2.99
ns
8 mA
STD
1.55
2.30
0.26
1.21
1.39
1.10
2.33
2.04
2.41
2.99
ns
Notes:
1. Software default selection highlighted in gray.
2. For specific junction temperature and voltage supply levels, refer to Table 2-6 on page 2-6 for derating values.
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PDF描述 |
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