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参数资料
| 型号： | AT89LP51-20PU |
| 厂商： | Atmel |
| 文件页数： | 37/117页 |
| 文件大小： | 0K |
| 描述： | MCU 8051 4K FLASH 20MHZ |
| 标准包装： | 10 |
| 系列： | 89LP |
| 核心处理器： | 8051 |
| 芯体尺寸： | 8-位 |
| 速度： | 20MHz |
| 连通性： | EBI/EMI，I²C，SPI，UART/USART |
| 外围设备： | 欠压检测/复位，POR，PWM，WDT |
| 输入/输出数： | 36 |
| 程序存储器容量： | 4KB（4K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 256 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.4 V ~ 5.5 V |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 40-DIP（0.600"，15.24mm） |
| 包装： | 管件 |
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26
3709D–MICRO–12/11
AT89LP51/52
5.2
Compatibility Mode
Compatibility (12-Clock) mode is enabled by default from the factory or by setting the Compati-
bility User Fuse. In Compatibility mode instruction bytes are fetched every three system clock
cycles and the CPU operates with 6-state machine cycles and a divide-by-2 system clock for 12
oscillator periods per machine cycle. Standard instructions execute in1, 2 or 4 machine cycles.
Instruction timing in this mode is compatible with standard 8051s such as the AT89S51/52.
Compatibility mode can be used to preserve the execution profiles of legacy applications. For a
summary of differences between Fast and Compatibility modes see Table 2-3 on page 10.
Examples of Compatibility mode instructions are shown in Figure 5-2.
Figure 5-2.
Instruction Execution Sequences in Compatibility Mode
5.3
Enhanced Dual Data Pointers
The AT89LP51/52 provides two 16-bit data pointers: DPTR0 formed by the register pair DPOL
and DPOH (82H an 83H), and DPTR1 formed by the register pair DP1L and DP1H (84H and
85H). The data pointers are used by several instructions to access the program or data memo-
ries. The Data Pointer Configuration Register (AUXR1) controls operation of the dual data
pointers (Table 5-3 on page 28). The DPS bit in AUXR1 selects which data pointer is currently
referenced by instructions including the DPTR operand. Each data pointer may be accessed at
its respective SFR addresses regardless of the DPS value. The AT89LP51/52 provides two
methods for fast context switching of the data pointers:
S1
S2
S3
S4
S5
S6
S1
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S1
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S1
S2
S3
S4
S5
S6
S1
CLK
ALE
READ OPCODE
(A) 1-byte, 1-cycle instruction, e.g., INC A
A
(B) 2-byte, 1-cycle instruction, e.g., ADD A, #data
(C) 1-byte, 2-cycle instruction, e.g., INC DPTR
(D) MOVX (1-byte, 2-cycle)
READ NEXT
OPCODE
(DISCARD)
READ NEXT OPCODE AGAIN
READ OPCODE
READ 2ND
BYTE
READ NEXT OPCODE
READ OPCODE
READ NEXT
OPCODE AGAIN
READ
OPCODE
(MOVX)
NO
ALE
READ NEXT
OPCODE (DISCARD)
READ NEXT
OPCODE
AGAIN
NO
FETCH
DA
DATA
ACCESS EXTERNAL MEMOR
ACCESS EXTERNAL MEMORY
ADDR
NO
FETCH
READ NEXT
OPCODE (DISCARD)
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PDF描述 |
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参数描述 |
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