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参数资料
| 型号： | AT89LP51-20PU |
| 厂商： | Atmel |
| 文件页数： | 62/117页 |
| 文件大小： | 0K |
| 描述： | MCU 8051 4K FLASH 20MHZ |
| 标准包装： | 10 |
| 系列： | 89LP |
| 核心处理器： | 8051 |
| 芯体尺寸： | 8-位 |
| 速度： | 20MHz |
| 连通性： | EBI/EMI，I²C，SPI，UART/USART |
| 外围设备： | 欠压检测/复位，POR，PWM，WDT |
| 输入/输出数： | 36 |
| 程序存储器容量： | 4KB（4K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 256 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.4 V ~ 5.5 V |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 40-DIP（0.600"，15.24mm） |
| 包装： | 管件 |
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49
3709D–MICRO–12/11
AT89LP51/52
.
11.5
Clock Output (Pin Toggle Mode)
On the AT89LP51/52, Timer 0 and Timer 1 may be independently configured to toggle their
respective counter pins, T0 and T1, on overflow by setting the T0OE or T1OE bits in TCONB.
The C/Tx bits must be set to “0” when in toggle mode and the T0 (P3.4) and T1 (P3.5) pins must
be configured in an output mode. The Timer Overflow Flags and Interrupts will continue to func-
tion while in toggle mode and Timer 1 may still generate the baud rate for the UART. The timer
GATE function also works in toggle mode, allowing the output to be halted by an external input.
Toggle mode can be used with Timer Mode 2 to output a 50% duty cycle clock with 8-bit pro-
grammable frequency. Tx is toggled at every Timer x overflow with the pulse width determined
by the value of THx. An example waveform is given in Figure 11-5. The following formula gives
the output frequency for Timer 0 in Mode 2.
Table 11-2.
TCON
– Timer/Counter Control Register
TCON = 88H
Reset Value = 0000 0000B
Bit Addressable
TF1
TR1
TF0
TR0
IE1
IT1
IE0
IT0
Bit
7
6
543
21
0
Symbol
Function
TF1
Timer 1 overflow flag. Set by hardware on Timer/Counter overflow. Cleared by hardware when the processor vectors
to interrupt routine.
TR1
Timer 1 run control bit. Set/cleared by software to turn Timer/Counter on/off.
TF0
Timer 0 overflow flag. Set by hardware on Timer/Counter overflow. Cleared by hardware when the processor vectors
to interrupt routine.
TR0
Timer 0 run control bit. Set/cleared by software to turn Timer/Counter on/off.
IE1
Interrupt 1 edge flag. Set by hardware when external interrupt edge detected. Cleared when interrupt processed.
IT1
Interrupt 1 type control bit. Set/cleared by software to specify falling edge/low level triggered external interrupts.
IE0
Interrupt 0 edge flag. Set by hardware when external interrupt edge detected. Cleared when interrupt processed.
IT0
Interrupt 0 type control bit. Set/cleared by software to specify falling edge/low level triggered external interrupts.
Table 11-3.
TCONB
– Timer/Counter Control Register B
TCONB = 91H
Reset Value = 0000 0000B
Not Bit Addressable
T1OE
T0OE
SPEN
––
–
Bit
7
6
543
21
0
Symbol
Function
T1OE
Timer 1 Output Enable. Configures Timer 1 to toggle T1 (P3.5) upon overflow.
T0OE
Timer 0 Output Enable. Configures Timer 0 to toggle T0 (P3.4) upon overflow.
SPEN
Enables SPI mode for UART mode 0
Mode 2:
f
out
System Frequency
2256
TH0
–
()
×
--------------------------------------------------
1
TPS
1
+
---------------------
×
=
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