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参数资料
| 型号： | DK-START-3C25N |
| 厂商： | Altera |
| 文件页数： | 27/34页 |
| 文件大小： | 0K |
| 描述： | KIT STARTER CYCLONE III EP3C25 |
| 产品培训模块： | Cyclone® III FPGA Three Reasons to Use FPGA's in Industrial Designs |
| 特色产品： | Cyclone? III FPGA Starter Kit |
| 标准包装： | 1 |
| 系列： | Cyclone® III |
| 类型： | FPGA |
| 适用于相关产品： | EP3C25 |
| 所含物品： | 开发板、Quartus?II 网络版、用户指南、参考手册、示意图、布局、BOM 等 |
| 产品目录页面： | 605 (CN2011-ZH PDF) |
| 相关产品： | EP3C25F256C7N-ND - IC CYCLONE III FPGA 256-FBGA 544-2565-ND - IC CYCLONE III FPGA 25K 324 FBGA EP3C25E144I7-ND - IC CYCLONE III FPGA 25K 144 EQFP EP3C25F256I7-ND - IC CYCLONE III FPGA 25K 256 FBGA EP3C25F324I7-ND - IC CYCLONE III FPGA 25K 324 FBGA EP3C25U256I7-ND - IC CYCLONE III FPGA 25K 256 UBGA 544-2546-ND - IC CYCLONE III FPGA 25K 256 UBGA 544-2545-ND - IC CYCLONE III FPGA 25K 256 UBGA 544-2544-ND - IC CYCLONE III FPGA 25K 324 FBGA 544-2543-ND - IC CYCLONE III FPGA 25K 256 FBGA 更多... |
| 其它名称： | 544-2370 |
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Chapter 1: Cyclone III Device Datasheet
1–27
Glossary
Literature website.
Glossary
Table 1–39. Glossary (Part 1 of 5)
Letter
A
B
C
D
E
F
G
H
Term
—
—
—
—
—
f HSCLK
GCLK
GCLK PLL
HSIODR
Input Waveforms
Definitions
—
—
—
—
—
HIGH-SPEED I/O Block: High-speed receiver/transmitter input and output clock frequency.
Input pin directly to Global Clock network.
Input pin to Global Clock network through PLL.
HIGH-SPEED I/O Block: Maximum/minimum LVDS data transfer rate (HSIODR = 1/TUI).
V IH
I
for the SSTL
Differential I/O
V SWING
V REF
Standard
V IL
TMS
TDI
t JCP
t JPSU_TDI
t JCH
t JCL
t JPSU_TMS
t JPH
TCK
J
JTAG Waveform
TDO
Signal
to be
t JPZX
t JSSU
t JSH
t JPCO
t JPXZ
Captured
t JSZX
t JSCO
t JSXZ
Signal
to be
Driven
K
L
M
July 2012
—
—
—
Altera Corporation
—
—
—
相关PDF资料 |
PDF描述 |
|---|---|
| DK-START-4CGX15N | KIT STARTER CYCLONE IV GX |
| DK-V5-EMBD-ML507-G-J | DEV KIT V5 W/ISM & EDK JAPAN |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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