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参数资料
| 型号： | DR-TRC103-950-DK |
| 厂商： | RFM |
| 文件页数： | 25/65页 |
| 文件大小： | 0K |
| 描述： | KIT DEV 950MHZ RFIC SRR |
| 标准包装： | 1 |
| 类型： | 收发器，SRR |
| 频率： | 950MHz ~ 960MHz |
| 适用于相关产品： | TRC103-950 |
| 已供物品： | 2 个板，天线，电池，线缆，CD，电源适配器 |
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The TRC103 packet handler provides a mechanism for scrambling the packet payload. A 9-bit LFSR is used to
generate a random sequence. The payload and the 16-bit CRC checksum are XOR’d with this random sequence
as shown in Figure 18. The data is descrambled on the receiver side by XORing with the same random se-
quence. The scrambling/descrambling process is enabled by setting the PKTCFG1E_Scrmb_En[4] bit to 1.
T R C 1 0 3 D a ta S c r a m b lin g Im p le m e n ta tio n
X 9 + X 5 + 1
X O R
S R 8
S R 5
S R 4
S R 0
X O R
S C R A M B L E D
D A T A O U T P U T
D A T A IN P U T
A ll 9 s h ift r e g is te r s p r e s e t to 1 b e fo r e e a c h s c r a m b lin g ( D C
b a la n c in g ) c a lc u la tio n
Figure 18
3.10 SPI Configuration Interface
The TRC103 contains two SPI-compatible interfaces, one to read and write the configuration registers, the other
to read and write FIFO data. Both interfaces are configured in slave mode and share the same pins: SDO (SPI
Slave Data Out), SDI (SPI Slave Data In), and SCK (Serial Clock). Two pins are provided to select the SPI con-
nection. The nSS_CONFIG pin allows access to the configuration registers and the nSS_DATA pin allows access
to the FIFO. Figure 19 shows a typical connection between a host microcontroller and the SPI interface.
T R C 1 0 3 - M ic r o c o n tr o lle r S ig n a l C o n n e c tio n s
IR Q 0
IR Q 1 /D C L K
D A T A
P L L _ L O C K
H o s t
M ic r o c o n tr o lle r
S C K
S D I
S D O
n S S _ D A T A
n S S _ C O N F IG
Figure 19
T R C 1 0 3
www.RFM.com E-mail: info@rfm.com
? 2009-2010 by RF Monolithics, Inc.
Technical support +1.800.704.6079
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TRC103 - 11/29/12
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