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参数资料
| 型号： | DR-TRC103-950-DK |
| 厂商： | RFM |
| 文件页数： | 51/65页 |
| 文件大小： | 0K |
| 描述： | KIT DEV 950MHZ RFIC SRR |
| 标准包装： | 1 |
| 类型： | 收发器，SRR |
| 频率： | 950MHz ~ 960MHz |
| 适用于相关产品： | TRC103-950 |
| 已供物品： | 2 个板，天线，电池，线缆，CD，电源适配器 |
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Pattern of Bits 4..3
00
01
10
11
Regulator Rise/Fall Times
3/3 μs
8.5/8.5 μs
15/15 μs
23/23 μs
OOK Rise/Fall Time
2.5/2 μs
5/3 μs
10/6 μs
20/10 μs
Table 62
It is generally a good practice to set the OOK rise and fall time to about 5% of a bit period to avoid excessive
modulation bandwidth:
t OOK = 50/BR
Where t OOK is the nominal 5% OOK rise/fall time in μs and BR is the bit rate in kb/s. At low OOK data rates the
20/10 μs rise/fall times given in the table above are satisfactory. When operating in the 863 - 870 MHz band under
ETSI EN300 220-1 regulations, check the modulation bandwidth carefully at bit rates above 8 kb/s to confirm
compliance. For operation in certain 863 - 870 MHz subbands, the required rise/fall time may be greater than 5%.
6.4 Frequency Synthesizer Channel Programming for FSK Modulation
When using a standard 12.8 MHz reference crystal, the FSK RF channel frequency is:
F RF = 14.4*(75*(P + 1) + S)/(R + 1), with P and S in the range 0 to 255, R in the range 64 to 169
Where F RF is in MHz, and P, S, and R are divider integers with S less than (P + 1). There are two sets of three
registers that hold the values of P, S and R:
Register
MCFG06
MCFG07
MCFG08
MCFG09
MCFG0A
MCFG0B
Divider Parameter
R1
P1
S1
R2
P2
S2
Table 63
MCFG00 bit 0 selects the register set to use for the frequency synthesizer. A 0 value selects register set MCFG06
- MCFG08 and a 1 value selects register set MCFG09 - MCFG0B . In addition, MCFG00 bits 4..3 select the oper-
ating band as follows:
MCFG00 bits 4..3
10
00
01
10
11
Band
863 - 870 MHz
902 - 915 MHz
915 - 928 MHz
950 - 960 MHz
not used
Table 64
www.RFM.com E-mail: info@rfm.com
? 2009-2010 by RF Monolithics, Inc.
Technical support +1.800.704.6079
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TRC103 - 11/29/12
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