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参数资料
| 型号： | DR-TRC103-950-DK |
| 厂商： | RFM |
| 文件页数： | 35/65页 |
| 文件大小： | 0K |
| 描述： | KIT DEV 950MHZ RFIC SRR |
| 标准包装： | 1 |
| 类型： | 收发器，SRR |
| 频率： | 950MHz ~ 960MHz |
| 适用于相关产品： | TRC103-950 |
| 已供物品： | 2 个板，天线，电池，线缆，CD，电源适配器 |
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0x12 - RXCFG12 [default 0x18]
Name
Bits
R/W
Description
Polyphase filter enable:
Polyfilt_En
7
r/w
0 → Polyphase filter disabled
1 → Polyphase filter enabled
Data and clock recovery enable:
DCLK_Dis
6
r/w
0 → Enabled
1 → Disabled
Start pattern detect (recognition) enable:
Recog
5
r/w
0 → Disabled
1 → Enabled
Start pattern size:
00 → 1 byte (SYNCGF16 byte)
Pat_sz
4,3
r/w
01 → 2 bytes (SYNCGF16 and SYNCGF17 bytes)
10 → 3 bytes (SYNCGF16, SYNCGF17 and SYNCGF18 bytes)
11 → 4 bytes (SYNCGF16, SYNCGF17, SYNCGF18, and SYNCGF19 bytes)
Start pattern bit-error tolerance limit:
00 → 0 errors
Ptol
2,1
r/w
01 → 1 error
10 → 2 errors
11 → 3 errors
-
0
-
Not used
Table 31
0x13 - RXCFG13 [default 0x07]
Name
Bits
R/W
Description
Reference clock counter/divider, F REF , for all digital circuitry:
RFClkRef
7..0
r/w
F REF = F XTAL /(F+1), 0 ≤ F ≤ 255, where F is the register value, F REF and F XTAL are in MHz
RFClkRef default = 0x07 (00000111b), F REF = 1. 6 MHz for F XTAL = 12.8 MHz
Table 32
0x14 - RXCFG14 [default 0x00]
Name
RSSI
Bits
7..0
R/W
r
Description
RSSI Output
Table 33
www.RFM.com E-mail: info@rfm.com
? 2009-2010 by RF Monolithics, Inc.
Technical support +1.800.704.6079
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TRC103 - 11/29/12
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