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参数资料
| 型号： | FX980L6 |
| 厂商： | CML MICROSYSTEMS PLC |
| 元件分类： | 消费家电 |
| 英文描述： | SPECIALTY CONSUMER CIRCUIT, PQCC44 |
| 封装： | PLASTIC, LCC-44 |
| 文件页数： | 42/86页 |
| 文件大小： | 821K |
| 代理商： | FX980L6 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页当前第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页
TETRA Baseband Processor
FX980
1997 Consumer Microcircuits Limited
47
D/980/3
TxFIFOStatMask
Title:
Transmit data FIFO Status interrupt Mask register
Address:
$0x23
Function:
RW
Description:
Masks interrupts in the TxFIFOStatus register. On taking N_RESET Low, these bits are set
active, so masking out all possible interrupt sources. Each inactive bit will allow its associated
status bit to generate an interrupt. In the case of the status bits marked in the TxFIFOStatus
register with a parenthesised ‘L’, taking the mask bit inactive will enable the latching
mechanism.
Bit
Name
Active State
Function
7
n_TxPathEn_Mask
Low
RW
Tx Data path active interrupt mask bit.
6
n_FIFOUnderRead_Mask
Low
RW
FIFO underflow interrupt mask bit.
5
n_FIFOOverWrite_Mask
Low
RW
FIFO overflow interrupt mask bit.
4
n_FIFOFull_Mask
Low
RW
FIFO full interrupt mask bit.
3
n_FIFOLength1_Mask
Low
RW
FIFO length status (MSB) interrupt mask bit.
2
n_FIFOLength0_Mask
Low
RW
FIFO length status (LSB) interrupt mask bit.
1
n_FIFOEmpty_Mask
Low
RW
FIFO empty interrupt mask bit.
0
Data
RW
Reserved for manufacturer’s test purposes. This bit
should be set Low.
Address and Data format for TxFIFOStatMask access
D1
R
D7 D6 D5 D4 D3 D2
Data field [7:0]
Address field [6:0]
1
0
1
0
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PDF描述 |
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参数描述 |
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