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参数资料
| 型号： | FX980L6 |
| 厂商： | CML MICROSYSTEMS PLC |
| 元件分类： | 消费家电 |
| 英文描述： | SPECIALTY CONSUMER CIRCUIT, PQCC44 |
| 封装： | PLASTIC, LCC-44 |
| 文件页数： | 62/86页 |
| 文件大小： | 821K |
| 代理商： | FX980L6 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页当前第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页
TETRA Baseband Processor
FX980
1997 Consumer Microcircuits Limited
65
D/980/3
RxIQOffset
Title:
Receive I and Q Channel Offset correction register
Address:
$0x32, $0x33, $0x36, and $0x37 (4 locations)
Function:
RW
Description:
This register controls the Rx Data path signal offset. This offset is a 2s-complement value
(N
offset), which is applied to the Rx signal after the Gain Multiplier (Gval), but before the 63-tap and
49-tap FIR filters. The offset applied is at the discretion of the user. Inappropriate values may
cause arithmetic overflow in the subsequent operator sections. The result is given by the
formula:
D
D +
N
2
out
in
offset
15
=
Where:
Din
Dout
N
offset
is the signal input,
is the signal output,
is the 2s-complement value
in the register.
Bit
Name
Active State
Function
Address $0x32
7:0
RxIOffsetLSB
Data RW
Least significant 8 bits of the RxIOffset register (N
offset).
Address $0x33
7:4
RW
Reserved. Set these bits Low. Undefined on read.
3:0
RxIOffsetMSB
Data RW
Most significant 4 bits of the RxIOffset register (N
offset).
Address $0x36
7:0
RxQOffsetLSB
Data RW
Least significant 8 bits of the RxQOffset register (N
offset).
Address $0x37
7:4
RW
Reserved. Set these bits Low. Undefined on read.
3:0
RxQOffsetMSB
Data RW
Most significant 4 bits of the RxQOffset register (N
offset).
相关PDF资料 |
PDF描述 |
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| FXO-HC320R-106.25M | CRYSTAL OSCILLATOR, CLOCK, 106.25 MHz, HCMOS OUTPUT |
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参数描述 |
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