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参数资料
| 型号： | HM66WP18513BP-65 |
| 元件分类： | SRAM |
| 英文描述： | 512K X 18 ZBT SRAM, 6.5 ns, PBGA119 |
| 封装： | BGA-119 |
| 文件页数： | 20/31页 |
| 文件大小： | 268K |
| 代理商： | HM66WP18513BP-65 |
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HM66WP18513, HM66WP36257
Rev.0.3, Mar. 2002, page 27 of 31
Boundary Scan Order (HM66WP18513BP)
Bit #
Bump ID
Signal name
Bit #
Bump ID
Signal name
12R
A5
36
2E
DQb7
2
2T
A10
37
2G
DQb6
3
3T
A15
38
1H
DQb5
4
5T
A14
39
5R
NC
5
6R
A12
40
2K
DQb4
63B
A3
41
1L
DQb3
75B
A9
42
2M
DQb2
8
7P
DQa0
43
1N
DQb1
9
6N
DQa1
44
2P
DQb0
10
6L
DQa2
45
3R
LBO
11
7K
DQa3
46
2C
A7
12
7T
ZZ
47
3C
A2
13
6H
DQa4
48
5C
A13
14
7G
DQa5
49
6C
A17
15
6F
DQa6
50
4N
A1
16
7E
DQa7
51
4P
A0
17
6D
DQa8
18
6T
A11
19
6A
A16
20
5A
A8
21
4G
A18
22
4A
NC
23
4B
ADV/
LD
24
4F
OE
25
4M
CEN
26
4H
WE
27
4K
CLK
28
6B
CE3
29
5L
BWa
30
3G
BWb
31
2B
CE2
32
4E
CE1
33
3A
A4
34
2A
A6
35
1D
DQb8
Notes:
1. Bit#1 is the first scan bit to exit the chip.
2. The NC pads listed in this table are indeed no connects, but are represented in the boundary scan register by
a “Place Holder”. Place holder registers are internally connected to V
SS.
3. ZZ must remain at V
IL during boundary scan.
相关PDF资料 |
PDF描述 |
|---|---|
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参数描述 |
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