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参数资料
| 型号： | IDT49C465PQF8 |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 算术逻辑单元 |
| 英文描述： | 49C SERIES, 32-BIT ERROR DETECT AND CORRECT CKT, PQFP144 |
| 封装： | PLASTIC, QFP-144 |
| 文件页数： | 24/39页 |
| 文件大小： | 299K |
| 代理商： | IDT49C465PQF8 |
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30
COMMERCIAL TEMPERATURE RANGE
IDT49C465/A
32-BIT FLOW-THRU ERROR DETECTION AND CORRECTION UNIT
AC TIMING DIAGRAMS—32-BIT CONFIGURATION
Figure 8. 32-Bit Detect Timing
Parameter
Name
Propagation Delay
From
To
Min./
Max.
MOE - High to M DOUT Disabled
tM EM xZ
MDIN Set-up to M LE = Low
tMMLS
tMMLH
Checkbit Set-up to M LE = Low
tCMLS
tCM LH
Checkbit Hold to M LE = Low
tM SY
MDIN to SYO OUT
tM E
max.
min.
max.
CBI
MLE
SYO
ERR
MOE
MD0-31
to
1
2
3
4
5
Valid
Checkbits In
to
1
234
5
tCM LS
tCM LH
MERR
(O UTPUT)
Valid
DA TAIN
tM EM xZ
MDIN Hold to M LE = Low
tMM LS
tMMLH
tCSY
tM LSY
(1)
tCE
tM LEx
(1)
tMME
tCM E
tMLEM x
(1)
max.
Checkbits in to SYO OUT
M LE = High to S YO OUT
MDIN to ER R = Low
Checkbits in to ERR = Low
M LE = High to E RR = Low
(1)
M LE = H igh to M ER R = Low
MDIN to M ERR = Low
Checkbits in to M ERR = Low
tM LEM x
(1)
tM M E
tCM E
tM SY
tCSY
tM E
tCE
tM LEx
(1)
tM LSY
(1)
NOTE:
1. Assumes that Memory Data and Checkbits are valid at least 3ns before MLE goes HIGH.
相关PDF资料 |
PDF描述 |
|---|---|
| IDT49FCT818AEB | 8-BIT, DSP-PIPELINE REGISTER, CDFP24 |
| IDT49FCT818P | 8-BIT, DSP-PIPELINE REGISTER, PDIP24 |
| IDT49FCT818L | 8-BIT, DSP-PIPELINE REGISTER, CQCC28 |
| IDT49FCT818LB | 8-BIT, DSP-PIPELINE REGISTER, CQCC28 |
| IDT49FCT818PB | 8-BIT, DSP-PIPELINE REGISTER, PDIP24 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IDT49C465PQFB | 制造商:IDT 制造商全称:Integrated Device Technology 功能描述:32-BIT FLOW-THRU ERROR DETECTION AND CORRECTION UNIT |
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