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参数资料
| 型号： | IDT70T631S |
| 厂商： | Integrated Device Technology, Inc. |
| 英文描述： | 122 x 32 pixel format, Compact LCD size |
| 中文描述： | 高速2.5V的512/256K与3.3V 5011 2.5V的接口× 18 ASYNCHRONO美国双端口静态RAM |
| 文件页数： | 18/27页 |
| 文件大小： | 342K |
| 代理商： | IDT70T631S |
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IDT70T633/1S
High-Speed 2.5V 512/256K x 18 Asynchronous Dual-Port Static RAM Industrial and Commercial Temperature Ranges
Timing Waveform of Write with Port-to-Port Read and
BUSY
(M/
S
= V
IH
)
(2,4,5)
Preliminary
18
Timing Waveform of Write with
BUSY
(M/
S
= V
IL
)
NOTES:
1. t
WH
must be met for both
BUSY
input (SLAVE) and output (MASTER).
2.
BUSY
is asserted on port "B" blocking R/
W
"B"
, until
BUSY
"B"
goes HIGH.
3. t
WB
only applies to the slave mode.
NOTES:
1. To ensure that the earlier of the two ports wins. t
APS
is ignored for M/
S
= V
IL
(SLAVE).
2.
CE
0L
=
CE
0R
= V
IL
; CE
1L
= CE
1R
= V
IH
.
3.
OE
= V
IL
for the reading port.
4. If M/
S
= V
IL
(slave),
BUSY
is an input. Then for this example
BUSY
"A"
= V
IH
and
BUSY
"B"
input is shown above.
5. All timing is the same for left and right ports. Port "A" may be either the left or right port. Port "B" is the port opposite from port "A".
5670 drw 14
t
DW
t
APS
ADDR
"A"
t
WC
DATA
OUT "B"
MATCH
t
WP
R/
W
"A"
DATA
IN "A"
ADDR
"B"
t
DH
VALID
(1)
MATCH
BUSY
"B"
t
BDA
VALID
t
BDD
t
DDD
(3)
t
WDD
t
BAA
.
5670 drw 15
R/
W
"A"
BUSY
"B"
t
WB
(3)
R/
W
"B"
t
WH
(1)
(2)
t
WP
.
相关PDF资料 |
PDF描述 |
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参数描述 |
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