参数资料
型号: IDT82V3255DK
厂商: INTEGRATED DEVICE TECHNOLOGY INC
元件分类: 通信及网络
英文描述: WAN PLL
中文描述: SPECIALTY TELECOM CIRCUIT, PQFP64
封装: TQFP-64
文件页数: 108/127页
文件大小: 868K
代理商: IDT82V3255DK
IDT82V3255
WAN PLL
Programming Information
108
June 19, 2006
PHASE_OFFSET[9:8]_CNFG - Phase Offset Configuration 2
Address:7BH
Type: Read / Write
Default Value: 0XXXXX00
Bit
Name
Description
7
PH_OFFSET_EN
This bit determines whether the input-to-output phase offset is enabled.
0: Disabled. (default)
1: Enabled.
Reserved.
These bits represent a 2’s complement signed integer. If the value is multiplied by 0.61, the input-to-output phase offset in ns
to adjust will be gotten.
6 - 2
-
1 - 0
PH_OFFSET[9:8]
7
6
5
4
3
2
1
0
PH_OFFSET_E
N
-
-
-
-
-
PH_OFFSET9
PH_OFFSET8
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