参数资料
| 型号： | ISL8120IRZEC |
| 厂商： | Intersil |
| 文件页数： | 15/33页 |
| 文件大小： | 0K |
| 描述： | IC REG CTRLR BUCK PWM VM 32-QFN |
| 标准包装： | 60 |
| PWM 型： | 电压模式 |
| 输出数： | 2 |
| 频率 - 最大： | 1.5MHz |
| 占空比： | 90% |
| 电源电压： | 3 V ~ 22 V |
| 降压： | 是 |
| 升压： | 无 |
| 回扫： | 无 |
| 反相： | 无 |
| 倍增器： | 无 |
| 除法器： | 无 |
| Cuk： | 无 |
| 隔离： | 无 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 32-VFQFN 裸露焊盘 |
| 包装： | 管件 |
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ISL8120IR
Electrical Specifications
Recommended Operating Conditions, Unless Otherwise Noted. Parameters with MIN and/or MAX limits are
100% tested at +25°C, unless otherwise specified. Temperature limits established by characterization and are
not production tested. (Continued)
PARAMETER
SYMBOL
TEST CONDITIONS
MIN
TYP
MAX
UNITS
OSCILLATOR
Oscillator Frequency Range
150
1500
kHz
Oscillator Frequency
Total Variation
Peak-to-Peak Ramp Amplitude
Linear Gain of Ramp Over V EN
Ramp Peak Voltage
Peak-to-Peak Ramp Amplitude
Peak-to-Peak Ramp Amplitude
Ramp Amplitude Upon Disable
Ramp Amplitude Upon Disable
Ramp DC Offset
Δ V RAMP
G RAMP
V RAMP_PEAK
Δ V RAMP
Δ V RAMP
Δ V RAMP
Δ V RAMP
V RAMP_OS
R FS = 100k, Figure 20
VCC = 5V; -40°C < T A <+85°C
VCC = 5V, V EN = 0.8V
G RAMP = Δ V RAMP /V EN
V EN = VCC
V EN = VCC = 5.4V, R UP = 2k
V EN = VCC = 3V; R UP = 2k
V EN = 0V; VCC = 3.5V to 5.5V
V EN = 0V; VCC < 3.4V
344
-9
377
1
1.25
VCC - 1.4
3
0.6
1
VCC - 2.4
1
406
+9
kHz
%
V P-P
V
V P-P
V P-P
V P-P
V P-P
V
FREQUENCY SYNCHRONIZATION AND PHASE LOCK LOOP
Synchronization Frequency
VCC = 5.4V (3V)
150
1500
kHz
PLL Locking Time
Input Signal Duty Cycle Range (Note 3)
VCC = 5.4V (3V); F SW = 400kHz;
10
105
90
μs
%
PWM
Minimum PWM OFF Time
Current Sampling Blanking Time (Note 3)
t MIN_OFF
t BLANKING
310
345
175
410
ns
ns
REFERENCE
Channel 1 Reference Voltage (Include
Error and Differential Amplifiers’ Offsets)
Channel 2 Reference Voltage (Include
Error and Differential Amplifiers’ Offsets)
V REF1
V REF2
-0.7
-0.75
0.6
0.6
0.7
0.95
V
%
V
%
ERROR AMPLIFIER
DC Gain (Note 3)
R L = 10k, C L = 100p, at COMP Pin
98
dB
Unity Gain-Bandwidth (Note 3)
Input Common Mode Range (Note 3)
UGBW_EA
R L = 10k, C L = 100p, at COMP Pin
-0.2
80
VCC - 1.8
MHz
V
Output Voltage Swing
VCC = 5V
0.85
VCC - 1.0
V
Slew Rate (Note 3)
Input Current (Note 3)
Output Sink Current
Output Source Current
Disable Threshold (Note 3)
SR_EA
I FB
I COMP
I COMP
V VSEN-
R L = 10k, C L = 100p, at COMP Pin
Positive direction into the FB pin
20
100
3
6
VCC - 0.4
V/μs
nA
mA
mA
V
DIFFERENTIAL AMPLIFIER
DC Gain (Note 3)
Unity Gain Bandwidth (Note 3)
Negative Input Source Current (Note 3)
Maximum Source Current for Current
Sharing (Typical Application VIII) (Note 3)
UG_DA
UGBW_DA
I VSEN-
I VSEN1-
Unity Gain Amplifier
VSEN1- Source Current for Current
Sharing when parallel multiple modules
0
5
100
350
dB
MHz
nA
μA
each of which has its own voltage loop
Input Impedance
R VSEN+_to
1
M Ω
_VSEN-
Output Voltage Swing (Note 3)
Input Common Mode Range (Note 3)
0
-0.2
VCC - 1.8
VCC - 1.8
V
V
15
FN6763.2
November 11, 2011
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PDF描述 |
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