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参数资料
| 型号： | M38D59GF-XXXFP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 6.25 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | 14 X 20 MM, 0.80 MM PITCH, PLASTIC, QFP-80 |
| 文件页数： | 100/142页 |
| 文件大小： | 2004K |
| 代理商： | M38D59GF-XXXFP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页当前第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页
Rev.3.04
May 20, 2008
REJ03B0158-0304
38D5 Group
CLOCK OUTPUT FUNCTION
A system clock
φ can be output from I/O port P72. The triple
function of I/O port, timer 2 output function and system clock
φ
output function are controlled by the clock output control register
(address 0FF316) and the timer 2 output selection bit of the timer
12 mode register (address 002516).
In order to output a system clock
φ from I/O port P72, set the
timer 2 output selection bit to “1” and P72 clock output control
bits of the clock output control register to “01”. In order to output
the same signal as oscillation frequency of sub clock XCIN, set
the P72 clock output control bits to “10”. When the clock output
function is selected, a clock is output while the direction register
of port P72 is set to the output mode.
P72 is switched to the port output or the output (timer 2 output or
the clock output) except port at the cycle after the timer 2 output
selection bit is switched.
Fig. 54 Structure of clock output control register
Fig. 55 Block diagram of Clock output function
Other function registers
[RRF register (RRFR)]
The RRF register (address 001216) is the 8-bit register and does
not have the control function.
As for the value written in this register, high-order 4 bits and
low-order 4 bits interchange.
It is initialized after reset.
Fig. 56 Structure of RRF register
b7
b0
Clock output control register
(CKOUT : address 0FF316)
P72 clock output control bits
b1b0
0 0: Timer 2 output
0 1:
φ frequency signal output
1 0: XCIN frequency signal output
1 1: Not available
Not used (returns “0” when read)
Timer 2 latch (8)
Timer 2 (8)
1/2
Q
S
T
T2OUT output edge
switch bit
“0”
“1”
P72 latch
Timer 2 output selection bit
P72 direction register
P72/T2OUT/CKOUT
b7
b0
Timer 12 mode register (address 002516)
T12M
Timer 2 output selection bit
0 : I/O port
1 : Timer 2 output
System clock
φ
Timer 2 output selection bit
XCIN
“00”
“01”
“10”
P72 clock output
control bits
b7
b0
RRF register
DB4 data storage
DB5 data storage
DB6 data storage
DB7 data storage
DB0 data storage
DB1 data storage
DB2 data storage
DB3 data storage
(RRFR : address 001216)
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