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参数资料
| 型号： | M38D59GF-XXXFP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 6.25 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | 14 X 20 MM, 0.80 MM PITCH, PLASTIC, QFP-80 |
| 文件页数： | 118/142页 |
| 文件大小： | 2004K |
| 代理商： | M38D59GF-XXXFP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页当前第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页
Rev.3.04
May 20, 2008
REJ03B0158-0304
38D5 Group
Fig 73. Structure of flash memory control register 2
Figure 74 shows a flowchart for setting/releasing CPU rewrite mode.
Fig 74. CPU rewrite mode set/release flowchart be sure to execute
Flash memory control register 2
(FMCR2: address : 0FE216, initial value: 4516)
Not used (return “1” when read)
Not used (do not write “1” to this bit.)
Not used (return “1” when read)
Not used (return “0” when read)
User block 0 E/W enable bit (1, 2)
0 : E/W disabled (800016-FFFF16)
1 : E/W enabled (800016-FFFF16)
Not used (return “0” when read)
Not used (return “1” when read)
Not used (return “0” when read)
b7
b0
Notes 1: For this bit to be set to “1”, the user needs to write a “0” and then a “1”
to it in succession. For this bit to be set to “0”, write “0” only to this bit.
2: Effective only when the CPU rewrite mode select bit = “1”.
Table 17
State of E/W inhibition function
User block 0
E/W enable bit
User block 1
E/W enable bit
User block 0
Addresses 800016 to FFFF16
User block 1
Addresses 180016 to 7FFF16
Data block
Addresses 100016 to 17FF16
0
E/W disabled
E/W enabled
0
1
E/W disabled
E/W enabled
1
0
E/W enabled
E/W disabled
E/W enabled
1
E/W enabled
Start
Single-chip mode or Boot mode
Set CPU mode register(1)
Jump to control program transferred to internal RAM
(Subsequent operations are executed by control program in
this RAM)
Transfer CPU rewrite mode control program to internal RAM
Set CPU rewrite mode select bit to “1” (by writing “0” and
then “1” in succession)
Using software command executes erase, program, or other
operation
End
Write “0” to CPU rewrite mode select bit
Set user block 0 E/W enable bit to “1” (by writing “0” and
then “1” in succession)
Set user block 1 E/W enable bit (At E/W disabled; writing
“0” , at E/W enabled;
writing “0” and then “1” in succession
Execute read array command(2)
Set user block 0 E/W enable bit to “0”
Set user block 1 E/W enable bit to “0”
Notes 1: Set the main clock as follows depending on the clock division ratio selection bits of CPU mode register (bits 6, 7 of address 003B16).
2: Before exiting the CPU rewrite mode after completing erase or program operation, always be sure to execute the read array command.
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