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参数资料
| 型号： | M65818AFP |
| 厂商： | Renesas Technology Corp. |
| 英文描述： | Digital Amplifier Processor of S-Master Technology |
| 中文描述： | 数字放大器处理器的S - Master技术 |
| 文件页数： | 37/39页 |
| 文件大小： | 384K |
| 代理商： | M65818AFP |
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M65818AFP
Rev.1.00, Sep.04.2003, page 37 of 38
8. Application Example
M65818AFP
LRCK
BCK
DATA
XfsiIN
(Primary Side Clock)
OUTL1+
OUTL1-
OUTL2+
OUTL2-
OUTR1+
OUTR1-
OUTR2+
OUTR2-
NSPMUTE
SCDT
SCSHIFT
SCLATCH
PGMUTE
INIT
XFsoIN
(Secondary Side Clock)
MCKSEL
DSP
MCU
DSD128FS
DSD64Fs
DSDR
DSDL
FsiI
(Clock for a primary side synchronization)
SACD
Decoder
E
X
D
A
T
A
L
E
X
D
A
T
A
R
E
X
B
C
K
E
X
W
C
K
External 8fs Data
Input: External Sampling
Rate Converter
Output: External DAC
E
X
I
O
S
E
L
External 8FsData Input/Output Setting
L: Input H: Output
DSDCKSEL1
DSDCKSEL2
DSDCKIO
Set Timing 1
SACD Interface
Set Timing 2
SACD Interface
Select shift clock I/O for DSD
L: Input H: Output
T
E
S
T
1
T
E
S
T
3
T
E
S
T
2
MODE1
MODE2
Set Input Mode1
FsoCKO
FsoI
Clock for a secondary side synchronization
(for Multi channel use)
Set Secondary Clock
L:1024Fso H:512Fso
CKCTL1
CKCTL2
CKOUT1
CKOUT2
CKOUT3
Set Secondary Clock 1
Set Secondary Clock 2
SYNC
Re-Synchronization
O
F
L
F
L
A
G
S
F
L
A
G
Flag Output
XFsoOUT
Oscillator
Power
Driver
Initialize
Mute Input
Secondary Clock Output 1
Set Input Mode 2
Secondary Clock Output 2
Secondary Clock Output 3
Secondary Clock Output
Power
Driver
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