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参数资料
| 型号： | MC68HC05G1B |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PDIP56 |
| 封装： | SDIP-56 |
| 文件页数： | 73/124页 |
| 文件大小： | 732K |
| 代理商： | MC68HC05G1B |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页当前第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页
MOTOROLA
6-6
MC68HC05G1
CLOCKS
6
ALE
1 (set)
–
Alarm interrupt enable
0 (clear) –
Alarm interrupt disable
SECE
1 (set)
–
Real time clock once a second interrupt enable
0 (clear) –
Real time clock once a second interrupt disable
It should be noted that the ags in the interrupt status register will be set if the corresponding event
is detected, irrespective of the setting of the interrupt enable bits.
Following is an example showing how to use the RTC interrupt:
*Main program
BSET
0,$1D
Enable RTC (once a day) interrupt.
BSET
1,$1D
Enable RTC (alarm) interrupt.
BSET
2,$1D
Enable RTC (once a second) interrupt.
STOP
MCU execute STOP instruction for power
conservation.
*Real time clock interrupt service routine
BRSET
0,$1C,ODAY
This bit is set indicating this is an once a
day RTC interrupt.
BRSET
1,$1C,ALINT
This bit is set indicating this is a RTC
interrupt caused by a match of alarm registers
and real time clock registers.
BRSET
2,$1C,OSEC
This bit is set indicating this is an once a
second RTC interrupt.
ODAY
BSET
0,$1C
Clear this bit so that this once a day
interrupt will not be recognized as a new one
on next RTC interrupt.
JSR
OADAY
Once a day interrupt service routine.
BRSET
1,$1C,ALINT
This bit is set indicating alarm interrupt
also occurs at the same time.
BRSET
2,$1C,OSEC
This bit is set indicating once a second RTC
interrupt also occurs at the same time.
RTCR
RTI
ALINT
BSET
1,$1C
Clear this bit so that this alarm interrupt
will not be recognized as a new one on next
RTC interrupt.
JSR
ALARM
Alarm service interrupt routine.
BRSET
2,$1C,OSEC
This bit is set indicating once a second
interrupt also occurs at the same time.
BRA
RTCR
Return from interrupt.
TPG
48
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| MC68HC05J1ACDW | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
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| MC68HC05J1ADW | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
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