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参数资料
| 型号： | MC68HC05SB7 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PDSO28 |
| 封装： | MO-150, SSOP-28 |
| 文件页数： | 155/170页 |
| 文件大小： | 2161K |
| 代理商： | MC68HC05SB7 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页当前第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页
August 27, 1998
GENERAL RELEASE SPECIFICATION
MC68HC05SB7
SM-BUS
MOTOROLA
REV 2.1
12-7
12.5.3 SM-Bus Control Register (SMCR)
SMEN — SM-Bus Enable
If the SM-Bus enable bit (SMEN) is set, the SM-Bus interface system is
enabled. If SMEN is cleared, the interface is reset and disabled.
The SMEN bit must be set rst before any bits of SMCR are set.
1 =
SM-Bus enabled.
0 =
SM-Bus disabled.
SMIEN — SM-Bus Interrupt Enable
If the SM-Bus interrupt enable bit (SMIEN) is set, the interrupt occurs provided
the SMIF ag in the status register is set and the I-bit in the Condition Code
Register is cleared. If SMIEN is cleared, the SM-Bus interrupt is disabled.
1 =
SM-Bus interrupt enabled.
0 =
SM-Bus interrupt disabled.
SMSTA — Master/Slave Select
Upon reset, this bit is cleared. When this bit is changed from 0 to 1, a START
signal is generated on the bus, and master mode is selected. When this bit is
changed from 1 to 0, a STOP signal is generated and the operating mode
changes from master to slave.
In master mode, a bit clear immediately followed by a bit set of this bit gener-
ates a repeated START signal (see Figure 12-2) without generating a STOP
signal.
1 =
SM-Bus is set for master mode operation.
0 =
SM-Bus is set for slave mode operation.
SMTX — Transmit/Receive Mode Select
This bit selects the SM-Bus to transmit or receive.
1 =
SM-Bus is set for transmit mode.
0 =
SM-Bus is set for receive mode.
TXAK — Acknowledge Enable
If the transmit acknowledge enable bit (TXAK) is cleared, an acknowledge sig-
nal will be sent out to the bus at the 9th clock bit after receiving one byte data.
When TXAK is set, no acknowledge signal response (i.e., acknowledge bit = 1).
1 =
Do not send acknowledge signal.
0 =
Send acknowledge signal at 9th clock bit.
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
SMCR
R
SMEN
SMIEN
SMSTA
SMTX
TXAK
SMUX
$0022
W
reset:
000000
U
相关PDF资料 |
PDF描述 |
|---|---|
| MC68HC705SB7 | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PDSO28 |
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| MC68HC05T2P | 8-BIT, MROM, MICROCONTROLLER, PDIP40 |
| MC68HC08AS32CFN | 8-BIT, EEPROM, 8.4 MHz, MICROCONTROLLER, PQCC52 |
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相关代理商/技术参数 |
参数描述 |
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| MC68HC05T16 | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:High-density complementary metal oxide semiconductor (HCMOS) microcontroller unit |
| MC68HC05V12 | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:HCMOS Microcontreller Unit |
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