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参数资料
| 型号： | MC68HC05SB7 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PDSO28 |
| 封装： | MO-150, SSOP-28 |
| 文件页数： | 166/170页 |
| 文件大小： | 2161K |
| 代理商： | MC68HC05SB7 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页当前第166页第167页第168页第169页第170页
August 27, 1998
GENERAL RELEASE SPECIFICATION
MC68HC05SB7
CURRENT SENSE AMPLIFIER
MOTOROLA
REV 2.1
13-3
CSEN — Current Sense Amplier Enable
This read/write bit enables the CSA module. Reset clears the CSEN bit.
1 =
CSA block enabled.
0 =
CSA block disabled.
X30, X10 — Current Sense Amplier Gain Select
These read/write bits enable the respective gain to be selected. See
Table 13-2. Reset clears the X30 and X10 bits.
Table 13-2. Current Sense Amplier Gain Select
CSCAL — Current Sense Amplier Calibration Enable
This read/write bit enables the CSA calibration. Reset clears the CSCAL bit.
1 =
CSA calibration enabled; current amplier input connected to
ground (VSS).
0 =
CSA calibration disabled; current amplier input from CSA pin.
CDEN — Current Detect Enable
This read/write bit enables the current detect comparator and current detect
output pin (CS0 or CS1) logic. Reset clears the CDEN bit.
1 =
Current detect comparator enabled.
0 =
Current detect comparator disabled.
CDIE — Current Detect Interrupt Enable
This read/write bit enables interrupts caused by detecting the current passing
through the sensing resistor, RSENSE. Reset clears the CDIE bit.
1 =
Current detect interrupt enabled.
0 =
Current detect interrupt disabled.
CDIFR — Current Detect Interrupt Flag Reset
Writing a logic “1” to this write-only bit clears the CDIF bit. CDIFR always reads
as a logic zero. Reset does not affect CDIFR.
1 =
Clear CDIF bit.
0 =
No affect on CDIF bit.
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
CSSCR
R
CSEN
X30
X10
CSCAL
CDEN
CDIE
0
CDIF
$000A
W
CDIFR
reset:
00000000
Figure 13-2. CSA Status and Control Register (CSSCR)
X30
X10
GAIN SELECTED
0
Don’t care
X10
1
0
X30
1
Undetermined
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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