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参数资料
| 型号： | MC68HC05T16B |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PDIP56 |
| 封装： | PLASTIC, SDIP-56 |
| 文件页数： | 112/128页 |
| 文件大小： | 734K |
| 代理商： | MC68HC05T16B |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页当前第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页
MOTOROLA
9-14
MC68HC05T16
ON-SCREEN DISPLAY
9
9.5.1
Frame Control 1 and Row Count Register
Bits 7 to 4 are control bits and, bits 3 to 0 are status bits.
PLLEN - PLL enable bit
1 (set)
–
PLL enabled for OSD clock source.
0 (clear) –
PLL disabled.
DSCAN - Double/Single scan mode select
1 (set)
–
Double scan mode.
0 (clear) –
Single scan mode.
DSCAN (double scan) bit is for the control of OSD logic so that the OSD can accommodate
non-interlaced scan TV system by adjusting dot matrix scan output. Users have to determine if the
target TV broadcast system is a double scan system. If DSCAN is set, all horizontal lines in the
character dot matrix will be displayed twice in the same frame. The other feature associated with
horizontal lines that will also be doubled is the RiVP6-RiVP0 eld of Row Vertical Position
Registers.
FADE - Display fade enable
1 (set)
–
Display fade function enabled.
0 (clear) –
Display fade function disabled.
The FADE bit controls the sequence of frame display appearance and disappearance. When
FADE bit is set, frame display will gradually appear (fade in) if ON/OFF is set, and gradually
disappear (fade out) if ON/OFF is clear. If FADE bit is clear, OSD display will be turned on or off
instantly.
Table 9-2 Number of Visible Characters Per Row
Address
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
State
on reset
$1D
PLLEN
DSCAN
FADE
ON/OFF
CDRC3
CDRC2
CDRC1
CDRC0
0000 0000
1H x 1V
2H x 2V
3H x 3V
4H x 4V
24
12
8
6
8
11
16
32
16x16
12x16
dot matrix
char size
TPG
82
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PDF描述 |
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