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参数资料
| 型号： | MC68HC05T16B |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PDIP56 |
| 封装： | PLASTIC, SDIP-56 |
| 文件页数： | 64/128页 |
| 文件大小： | 734K |
| 代理商： | MC68HC05T16B |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页当前第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页
MOTOROLA
4-10
MC68HC05T16
RESETS AND INTERRUPTS
4
4.2.6
PAC Interrupt
Pulse Accumulator interrupt is enabled when the enable bit, PAIE of PAC Control register is set.
The interrupt service routine address for PAC is specied by the contents of memory location
$FFF2 and $FFF3.
PAOF - PAC Overow Interrupt Flag Bit.
1 (set)
–
A PAC overow from $FF to $00 has occurred.
0 (clear) –
No PAC overow has occurred.
It is set when the count in the pulse accumulator rolls over from $FF to $00. PAOF is cleared by
writing a “0” to the bit. An interrupt to the CPU is generated if the PAIE bit is set.
PAIE - PAC Interrupt Enable Bit
1 (set)
–
PAC overow Interrupt enabled.
0 (clear) –
PAC overow Interrupt disabled.
Refer to section 7 for detailed description of Pulse Accumulator.
4.2.7
OSD Interrupts
There are ve OSD interrupt sources, VFLBK bit and R0/1/2/3CF bits of OSD Status register, in
the OSD module. VFLB bit will be set whenever the leading edge of vertical yback pin, VFLBK,
has been detected. An interrupt will occur if the corresponding interrupt enable bit, VFINTE, is set.
Whenever each row terminates its display, RiCF bit will be set and an interrupt will be generated
provided that the corresponding interrupt enable bit, RiINTE is set. The interrupt service routine
address is specied by the contents of memory location $FFFA and $FFFB.
VFINTE - VFLBK interrupt enable
1 (set)
–
Vertical yback interrupt enabled.
0 (clear) –
Vertical yback interrupt disabled.
Address
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
State
on reset
PACTL
$0E
PAOF
PAEN PAMOD PAIE
0000 0000
Address
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
State
on reset
Frame Control 3 and Status
$2B
VFINTE MUTE1 MUTE0 VFLB
R3CF
R2CF
R1CF
R0CF 0000 0000
TPG
38
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PDF描述 |
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