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参数资料
| 型号： | MPC563MZP66R2 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, FLASH, 66 MHz, RISC MICROCONTROLLER, PBGA388 |
| 封装： | 27 X 27 MM, 1 MM PITCH, PLASTIC, MO-151, BGA-388 |
| 文件页数： | 546/1496页 |
| 文件大小： | 20425K |
| 代理商： | MPC563MZP66R2 |
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MOTOROLA
Chapter 3. Central Processing Unit
3-7
Levels of the PowerPC ISA Architecture
3.4.4
Floating-Point Unit (FPU)
The FPU contains a double-precision multiply array, the floating-point status and control
register (FPSCR), and the FPRs. The multiply-add array allows the RCPU to efficiently
implement floating-point operations such as multiply, multiply-add, and divide.
The RCPU depends on a software envelope to fully implement the IEEE floating-point
specification. Overflows, underflows, NaNs (not a number), and denormalized numbers
cause floating-point assist exceptions that invoke a software routine to deliver (with
hardware assistance) the correct IEEE result.
To accelerate time-critical operations and make them more deterministic, the RCPU
provides a mode of operation that avoids invoking a software envelope and attempts to
deliver results in hardware that are adequate for most applications, if not in strict
compliance with IEEE standards. In this mode, denormalized numbers, NaNs, and IEEE
invalid operations are legitimate, returning default results rather than causing floating-point
assist exceptions.
3.5
Levels of the PowerPC ISA Architecture
The PowerPC ISA architecture consists of three levels:
User instruction set architecture (UISA) — defines the base user-level instruction
set, user-level registers, data types, floating-point exception model, memory models
for a uniprocessor environment, and programming model for a uniprocessor
environment.
Virtual environment architecture (VEA) — describes the memory model for a
multiprocessor environment, and describes other aspects of virtual environments.
Implementations that conform to the VEA also adhere to the UISA, but may not
necessarily adhere to the OEA.
Operating environment architecture (OEA) — defines the memory-management
model, supervisor-level registers, synchronization requirements, and the exception
model.
Implementations that conform to the OEA also adhere to the UISA and the VEA.
Adherence to the PowerPC ISA architecture can be measured in terms of which of the
levels are implemented.
相关PDF资料 |
PDF描述 |
|---|---|
| MC68HC08AB16ACFU | 8-BIT, EEPROM, 8 MHz, MICROCONTROLLER, PQFP64 |
| MPC8250ACZUMIBX | 32-BIT, 266 MHz, RISC PROCESSOR, PBGA480 |
| MPC860DPCZQ50D4 | 32-BIT, 50 MHz, RISC PROCESSOR, PBGA357 |
| MPC860SRZQ50D4R2 | 32-BIT, 50 MHz, RISC PROCESSOR, PBGA357 |
| MC68HC11L6BCFU2 | 8-BIT, MROM, 2 MHz, MICROCONTROLLER, PQFP64 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| MPC564 | 制造商:未知厂家 制造商全称:未知厂家 功能描述:NEXUS Debugger and Trace for PowerPC |
| MPC5642A | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Qorivva MPC5642A Microcontroller |
| MPC5643L | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:MPC5643L Microcontroller Data Sheet |
| MPC5643L_11 | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:High-performance e200z4d dual core |
| MPC5643L_12 | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Qorivva Microcontroller |
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