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参数资料
| 型号： | MPC9600AE |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 9/15页 |
| 文件大小： | 0K |
| 描述： | IC PLL CLK DRIVER LV 48-LQFP |
| 标准包装： | 250 |
| 类型： | PLL 时钟驱动器 |
| PLL： | 带旁路 |
| 输入： | LVCMOS，LVPECL |
| 输出： | LVCMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:21 |
| 差分 - 输入:输出： | 是/无 |
| 频率 - 最大： | 200MHz |
| 除法器/乘法器： | 是/是 |
| 电源电压： | 2.375 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-LQFP |
| 供应商设备封装： | 48-TQFP（7x7） |
| 包装： | 托盘 |
MPC9600 REVISION 6 JANUARY 7, 2013
3
2013 Integrated Device Technology, Inc.
MPC9600 Data Sheet
LOW VOLTAGE, 2.5V AND 3.3V LVCMOS PLL CLOCK DRIVER
Figure 2. 48-Lead Package Pinout (Top View)
Table 1. Pin Configuration – 48 LQFP
Pin
I/O
Type
Description
PCLK, PCLK
Input
PECL
Differential reference clock frequency input
CCLK
Input
LVCMOS
Reference clock input
FB_IN
Input
LVCMOS
PLL feedback clock input
QAn
Output
LVCMOS
Bank A outputs
QBn
Output
LVCMOS
Bank B outputs
QCn
Output
LVCMOS
Bank C outputs
QFB
Output
LVCMOS
Differential feedback output
REF_SEL
Input
LVCMOS
Reference clock input select
FSELA
Input
LVCMOS
Selection of bank A output frequency
FSELB
Input
LVCMOS
Selection of bank B output frequency
FSELC
Input
LVCMOS
Selection of bank C output frequency
FSEL_FB
Input
LVCMOS
Selection of feedback frequency
OE
Input
LVCMOS
Output enable
VCCA
Power supply
Analog power supply and PLL bypass. An external VCC filter is recommended for VCCA
VCC
Power supply
Core power supply
GND
Ground
GND
QA3
QA2
VCC
QA1
QA0
GND
VCC
QC3
QC4
GND
QC5
QC6
GND
QFB
QB0
QB1
V
CC
QB2
QB3
GND
CCLK
PCLK
V
CC
REF
_SEL
FSE
L_FB
V
CCA
41
42
43
44
45
46
47
48
19
18
17
16
15
14
13
12
3
4
5
6
78
36
35
34
33
32
31
30
29
20
MPC9600
FB_IN
OE
VCC
FSELA
FSELB
FSELC
GND
910
11
12
GND
QC0
QC1
QC2
23
22
21
24
QB4
QB5
QB6
V
CC
28
27
26
25
VCC
QA6
QA5
37
38
39
40
QA4
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