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参数资料
| 型号： | MT46V2M32LG |
| 厂商： | Micron Technology, Inc. |
| 英文描述： | DOUBLE DATA RATE DDR SDRAM |
| 中文描述： | 双倍数据速率的DDR SDRAM内存 |
| 文件页数： | 53/65页 |
| 文件大小： | 2360K |
| 代理商： | MT46V2M32LG |
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53
64Mb: x32 DDR SDRAM
2M32DDR-07.p65
–
Rev. 12/01
Micron Technology, Inc., reserves the right to change products or specifications without notice.
2001, Micron Technology, Inc.
64Mb: x32
DDR SDRAM
Figure 28
Data Output Timing
–
t
DQSQ,
t
QH, and Data Valid Window
DQ (Last data valid)
DQ
DQ
DQ
DQ
DQ
DQ
DQS
1
DQ (Last data valid)
DQ (First data no longer valid)
DQ (First data no longer valid)
All DQs and DQS, collectively
5
NOTE:
1. DQs transitioning after DQS transition define tDQSQ window. DQS transitions at T2 and at T2n are an early DQS,
at T3 is a nominal DQS, and at T3n is a late DQS.
2. tDQSQ is derived at each DQS clock edge and is not cumulative over time and begins with DQS transition and
ends with the last valid transition of DQs .
3. tQH is derived from tHP: tQH = tHP
4. tHP is the lesser of tCL or tCH clock transition collectively when a bank is active.
5. The data valid window is derived for each DQS transitions and is defined as tQH minus tDQSQ.
Earliest signal transition
Latest signal transition
T2
T2
T2
T2n
T2n
T2n
T3
T3
T3
T3n
T3n
T3n
CK
CK#
T1
T2
T3
T4
T2n
T3n
tQH
3
tHP
4
tHP
4
tHP
4
tQH
3
tQH
3
tHP
4
tHP
4
tHP
4
tQH
3
tDQSQ
2
tDQSQ
2
tDQSQ
2
tDQSQ
2
Data
Valid
window
Data
Valid
window
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Valid
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Data
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window
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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