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参数资料
| 型号： | PIC17CXX |
| 厂商： | Microchip Technology Inc. |
| 英文描述： | EPROM Memory Programming Specification |
| 中文描述： | EPROM存储器编程规范 |
| 文件页数： | 29/71页 |
| 文件大小： | 1173K |
| 代理商： | PIC17CXX |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页当前第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页
1996 Microchip Technology Inc.
DS30412C-page 35
PIC17C4X
Bank 2
10h
TMR1
Timer1
xxxx xxxx
uuuu uuuu
11h
TMR2
Timer2
xxxx xxxx
uuuu uuuu
12h
TMR3L
TMR3 register; low byte
xxxx xxxx
uuuu uuuu
13h
TMR3H
TMR3 register; high byte
xxxx xxxx
uuuu uuuu
14h
PR1
Timer1 period register
xxxx xxxx
uuuu uuuu
15h
PR2
Timer2 period register
xxxx xxxx
uuuu uuuu
16h
PR3L/CA1L
Timer3 period register, low byte/capture1 register; low byte
xxxx xxxx
uuuu uuuu
17h
PR3H/CA1H
Timer3 period register, high byte/capture1 register; high byte
xxxx xxxx
uuuu uuuu
Bank 3
10h
PW1DCL
DC1
DC0
—
xx-- ----
uu-- ----
11h
PW2DCL
DC1
DC0
TM2PW2
—
xx0- ----
uu0- ----
12h
PW1DCH
DC9
DC8
DC7
DC6
DC5
DC4
DC3
DC2
xxxx xxxx
uuuu uuuu
13h
PW2DCH
DC9
DC8
DC7
DC6
DC5
DC4
DC3
DC2
xxxx xxxx
uuuu uuuu
14h
CA2L
Capture2 low byte
xxxx xxxx
uuuu uuuu
15h
CA2H
Capture2 high byte
xxxx xxxx
uuuu uuuu
16h
TCON1
CA2ED1
CA2ED0
CA1ED1
CA1ED0
T16
TMR3CS
TMR2CS
TMR1CS
0000 0000
17h
TCON2
CA2OVF CA1OVF PWM2ON
PWM1ON
CA1/PR3 TMR3ON
TMR2ON
TMR1ON
0000 0000
Unbanked
18h (5)
PRODL
Low Byte of 16-bit Product (8 x 8 Hardware Multiply)
xxxx xxxx
uuuu uuuu
19h (5)
PRODH
High Byte of 16-bit Product (8 x 8 Hardware Multiply)
xxxx xxxx
uuuu uuuu
TABLE 6-3:
SPECIAL FUNCTION REGISTERS (Cont.’d)
Address
Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Value on
Power-on
Reset
Value on all
other
resets (3)
Legend:
x = unknown, u = unchanged, - = unimplemented read as '0', q - value depends on condition. Shaded cells are unimplemented, read as '0'.
Note 1:
The upper byte of the program counter is not directly accessible. PCLATH is a holding register for PC<15:8> whose contents are updated
from or transferred to the upper byte of the program counter.
2:
The TO and PD status bits in CPUSTA are not affected by a MCLR reset.
3:
Other (non power-up) resets include: external reset through MCLR and the Watchdog Timer Reset.
4:
The following values are for both TBLPTRL and TBLPTRH:
All PIC17C4X devices (Power-on Reset 0000 0000) and (All other resets 0000 0000)
except the PIC17C42 (Power-on Reset xxxx xxxx) and (All other resets uuuu uuuu)
5:
The PRODL and PRODH registers are not implemented on the PIC17C42.
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