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参数资料
| 型号： | PM73487-PI |
| 厂商： | PMC-SIERRA INC |
| 元件分类： | 数字传输电路 |
| 英文描述： | 622 Mbps ATM Traffic Management Device |
| 中文描述： | ATM/SONET/SDH SUPPORT CIRCUIT, PBGA503 |
| 封装： | EPBGA-503 |
| 文件页数： | 195/251页 |
| 文件大小： | 3126K |
| 代理商： | PM73487-PI |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页当前第195页第196页第197页第198页第199页第200页第201页第202页第203页第204页第205页第206页第207页第208页第209页第210页第211页第212页第213页第214页第215页第216页第217页第218页第219页第220页第221页第222页第223页第224页第225页第226页第227页第228页第229页第230页第231页第232页第233页第234页第235页第236页第237页第238页第239页第240页第241页第242页第243页第244页第245页第246页第247页第248页第249页第250页第251页
PM73487 QRT
PMC-Sierra, Inc.
PMC-980618
Issue 3
622 Mbps ATMTraffic Management Device
Released
Datasheet
183
9.3
Table 39 summarizes the contents of the CH_RAM.
Channel RAM (CH_RAM)
9.3.1
Channel Control Block
Base address: 400000
h
(01000000
h
byte)
Index:10
h
Entry number (refer to
“CH_RAM_CONFIG” on page 105
)
For CH_RAM_CONFIG = 0
h
, the entry number is from 0 to 2047.
For CH_RAM_CONFIG = 1
h
, the entry number is from 0 to 4095.
For CH_RAM_CONFIG = 2
h
, the entry number is from 0 to 8191.
For CH_RAM_CONFIG = 3
h
, the entry number is from 0 to 16385.
Type: Read/Write
Long address:
In the receive direction, the long address = 400000
h
+
RX_CHAN_NUM
×
10
h
+
long_offset
In the transmit direction, the long address = 400000
h
+
OUTCHAN
×
10
h
+
long_offset
.
Table 39. Channel RAM (CH_RAM) Summary
Byte
Offset
Long
Offset
Name
Read or
Write
Description
01000000
h
01000000
h
400000
h
400000
h
Channel Control Block (CCB)
Multicast Control Block
R/W
R/W
Receive and transmit per-channel control block.
Control block for transmit multicast linked lists.
Table 40. Channel Control Block Summary
Byte
Offset
Long
Offset
Name
Read or
Write
Description
0
h
0
h
RX_CH_CONFIG
R/W
Overall controls for channel.
4
h
1
h
RX_CH_TAG
R/W
Switch fabric tag.
8
h
2
h
RX_CH_NEW_VPI_VCI
R/W
VPI/VCI to which you want to translate.
C
h
3
h
RX_CH_STATE
R/W (init
only)
Current channel state.
10
h
4
h
Not used
R/W
Write with a 0 to maintain software compatibility with future versions.
14
h
5
h
RX_CH_NEXT_CH
R/W (init
only)
The next channel in the round-robin linked list.
18
h
6
h
Reserved
R/W (init
only)
Initialize to 0 at initial setup. Software modifications to this location
after setup may cause incorrect operation.
1C
h
7
h
Reserved
R/W (init
only)
Initialize to 0 at initial setup. Software modifications to this location
after setup may cause incorrect operation.
20
h
8
h
RX_CH_SEQ_ST
R/W (init
only)
State of the sequencing algorithm.
24
h
9
h
Not used
R/W
Write with a 0 to maintain software compatibility with future versions.
28
h
A
h
TX_CH_CONFIG
R/W
Overall controls for the channel.
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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| PM7349 | 制造商:PMC 制造商全称:PMC 功能描述:Quad J2, E3 and DS-3 Framer |
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