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参数资料
| 型号： | PM73488-PI |
| 厂商： | PMC-SIERRA INC |
| 元件分类： | 数字传输电路 |
| 英文描述： | 5 Gbit/s ATM Switch Fabric Element |
| 中文描述： | ATM SWITCHING CIRCUIT, PBGA596 |
| 封装： | EPBGA-596 |
| 文件页数： | 86/135页 |
| 文件大小： | 1735K |
| 代理商： | PM73488-PI |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页当前第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页
PMC-Sierra, Inc.
PM73488 QSE
L
PMC-980616
Issue 3
5 Gbit/s ATMSwitch Fabric Element
Released
Datasheet
88
8.3
Figure 39 shows the bit-level timing for the QSE.
QSE Interface Timing
Tq
RAM_CLK-to-output delay
/RAM_WR, /RAM_OE,
RAM_DATA
RAM_DATA
RAM_DATA
RAM_ADD
1.5
9
ns
Tsd
Thd
Tqa
RAM_CLK setup time
RAM_CLK hold time
RAM_CLK-to-output delay
5.2
0
1.5
ns
ns
ns
10
Figure 39. QSE Bit-Level Timing
Symbol
Parameter
Signals
Min
Max
Unit
Fseclk
Frequency of SE_CLK
SE_CLK
35
a
66
MHz
Tctsu
Control signal setup
CELL_START, CELL_24_START
8.0
ns
Tctho
Control signal hold
CELL_START, CELL_24_START
0
ns
Tseq
Output delay from SE_CLK
SE_D_OUT (15 pF),
BP_ACK_OUT(31:0),
SE_SOC_OUT(7:0)
b
1
6
ns
Output delay skew *
SE_D_OUT(0,3:0) and SE_SOC_OUT
SE_D_OUT(1,3:0) and SE_SOC_OUT
SE_D_OUT(2,3:0) and SE_SOC_OUT
SE_D_OUT(3,3:0) and SE_SOC_OUT
1.9
ns
Input delay skew *
SE_D_IN(0,3:0) and SE_SOC_IN(0)
SE_D_IN(1,3:0) and SE_SOC_IN(1)
SE_D_IN(2,3:0) and SE_SOC_IN(2)
SE_D_IN(3,3:0) and SE_SOC_IN(3)
3.5
ns
*
When the phase aligners are turned on, Tsesu and Tseho are no longer defined. However, the maximum input and output
skew and jitter on these signals with respect to the SE_SOC_IN is constrained to specification listed in this table.
Table 28.
RAM Interface Timing (Continued)
Symbol
Parameter
Conditions
Min
Max
Unit
Tctsu
Tsesu
Fseclk
Tseho
Tseq
Tctho
Tseq
SE_CLK
SE_D_IN(31:0, 3:0), BP_ACK_IN(31:0)
SE_D_OUT(31:0,3:0), BP_ACK_OUT(31:0)
CELL_START, CELL_24_START
SE_SOC_OUT(7:0)
相关PDF资料 |
PDF描述 |
|---|---|
| PM73488 | 5 Gbit/s ATM Switch Fabric Element |
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| PM7350 | Dual Serial Link, PHY Multiplexer |
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参数描述 |
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