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参数资料
| 型号： | ST10F269DIETR |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 32 MHz, MICROCONTROLLER, UUC |
| 封装： | DIE |
| 文件页数： | 43/161页 |
| 文件大小： | 1595K |
| 代理商： | ST10F269DIETR |
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ST10F269-T3
137/160
The mechanism used to generate the CPU clock is selected during reset by the logic levels on pins
P0.15-13 (P0H.7-5).
21.4.3 - Clock Generation Modes
The Table 34 associates the combinations of these three bits with the respective clock generation mode.
Notes: 1. The external clock input range refers to a CPU clock range of 1...32MHz.
2. The maximum input frequency depends on the duty cycle of the external clock signal.
3. The maximum input frequency is 32MHz when using an external crystal with the internal oscillator; providing that internal serial
resistance of the crystal is less than 40
. However, higher frequencies can be applied with an external clock source on pin XTAL1,
but in this case, the input clock signal must reach the defined levels VIL and VIH2..
Figure 67 : Generation Mechanisms for the CPU Clock
Table 34 : CPU Frequency Generation
P0H.7 P0H.6 P0H.5 CPU Frequency fCPU = fXTAL x F External Clock Input Range1
Notes
11
1
fXTAL x 4
2.5 to 8MHz
Default configuration
11
0
fXTAL x 3
3.33 to 10.67MHz
10
1
fXTAL x 2
5 to 16MHz
10
0
fXTAL x 5
2 to 6.4MHz
01
1
fXTAL x 1
1 to 32MHz
Direct drive2
01
0
fXTAL x 1.5
6.67 to 21.33MHz
00
1
fXTAL x 0.5
2 to 64MHz
CPU clock via prescaler3
00
0
fXTAL x 2.5
4 to 12.8MHz
0
00
TCL TCL
0
00
TCL TCL
fCPU
fXTAL
fCPU
fXTAL
Phase locked loop operation
Direct Clock Drive
000000
000
TCL
fCPU
fXTAL
Prescaler Operation
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