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参数资料
型号： ST10F269DIETR
厂商： STMICROELECTRONICS
元件分类： 微控制器/微处理器
英文描述： 16-BIT, FLASH, 32 MHz, MICROCONTROLLER, UUC
封装： DIE
文件页数： 45/161页
文件大小： 1595K
代理商： ST10F269DIETR
ST10F269-T3
139/160
The real minimum value for TCL depends on the
jitter of the PLL. The PLL tunes fCPU to keep it
locked on fXTAL. The relative deviation of TCL is
the maximum when it is referred to one TCL
period. It decreases according to the formula and
to the Figure 68 given below. For
N periods of TCL
the minimum value is computed using the
corresponding deviation DN:
where N = number of consecutive TCL periods
and 1
≤ N ≤ 40. So for a period of 3 TCL periods
(N = 3):
D3
=
4 - 3/15 = 3.8%
3TCLmin
=3TCLNOM x (1 - 3.8/100)
=3TCLNOM x 0.962
3TCLmin
=
45.1ns (at fCPU = 32MHz)
This is especially important for bus cycles using wait
states and e.g. for the operation of timers, serial
interfaces, etc. For all slower operations and longer
periods (e.g. pulse train generation or measurement,
lower Baud rates, etc.) the deviation caused by the
PLL jitter is negligible.
21.4.8 - External Clock Drive XTAL1
VDD = 5V ± 10%, VSS = 0V, TA = -40 to +125 °C
Notes: 1. Theoretical minimum. The real minimum value depends on the duty cycle of the input clock signal. 32MHz is the maximum input
frequency when using an external crystal oscillator. However, 32MHz can be applied with an external clock source.
2. The input clock signal must reach the defined levels VIL and VIH2.
TCL
MIN
TCL
NOM
1
D
N
100
-------------
–
×
=
D
N
4N 15
) %
[]
–
(
±
=
Figure 68 : Approximated Maximum PLL Jitter
Parameter
Symbol
fCPU = fXTAL
fCPU = fXTAL / 2
fCPU = fXTAL x F
F = 1.5/2,/2.5/3/4/5
Unit
Minimum
Maximum
Minimum
Maximum
Minimum
Maximum
Oscillator period
tOSC SR
31.251
–
15.625
–
31.25 x N
–
ns
High time
t1
SR
12.52
–
6.252
–
12.52
–
ns
Low time
t2
SR
12.52
–
6.252
–
12.52
–
ns
Rise time
t3
SR
–
3.1252
–
1.562
–
3.1252
ns
Fall time
t4
SR
–
3.1252
–
1.562
–
3.1252
ns
32
16
8
4
2
±1
±2
±3
±4
Max.jitter [%]
N
This approximated formula is valid for
1
≤ N ≤ 40 and 10MHz ≤ f
CPU ≤ 32MHz.
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