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参数资料
型号： ST10F269DIETR
厂商： STMICROELECTRONICS
元件分类： 微控制器/微处理器
英文描述： 16-BIT, FLASH, 32 MHz, MICROCONTROLLER, UUC
封装： DIE
文件页数： 48/161页
文件大小： 1595K
代理商： ST10F269DIETR
ST10F269-T3
141/160
21.4.10 - Multiplexed Bus
VDD = 5V ± 10%, VSS = 0V, TA = -40 to +125°C, CL = 50pF,
ALE cycle time = 6 TCL + 2tA + tC + tF (187.5ns at 32MHz CPU clock without wait states).
Table 35 : Multiplexed Bus Characteristics
Symbol
Parameter
Maximum CPU Clock =
32MHz
Variable CPU Clock
1/2 TCL = 1 to 32MHz
Unit
Minimum
Maximum
Minimum
Maximum
t5
CC
ALE high time
5.625 + tA
–
TCL - 10 + tA
–ns
t6
CC
Address setup to ALE
0.625 + tA
–
TCL - 15+ tA
–ns
t7
CC
Address hold after ALE
1
5.625 + tA
–
TCL - 10 + tA
–ns
t8
CC
ALE falling edge to RD, WR
(with RW-delay)
5.625 + tA
–
TCL - 10 + tA
–ns
t9
CC
ALE falling edge to RD, WR (no
RW-delay)
-10 + tA
–-10 + tA
–ns
t10
CC
Address float after RD, WR
(with RW-delay)
1
–6
–
6
ns
t11
CC
Address float after RD, WR
(no RW-delay)
1
–
21.625
–
TCL + 6
ns
t12
CC
RD, WR low time
(with RW-delay)
21.25 + tC
–
2TCL - 10 + tC
–ns
t13
CC
RD, WR low time
(no RW-delay)
36.875 + tC
–
3TCL - 10 + tC
–ns
t14
SR
RD to valid data in
(with RW-delay)
–
11.25 + tC
–
2TCL - 20+ tC
ns
t15
SR
RD to valid data in
(no RW-delay)
–
26.875 + tC
–
3TCL - 20+ tC
ns
t16
SR
ALE low to valid data in
–
26.875 + tA + tC
–
3TCL - 20
+ tA + tC
ns
t17
SR
Address/Unlatched CS to valid
data in
–
32.5 + 2tA + tC
–
4TCL - 30
+ 2tA + tC
ns
t18
SR
Data hold after RD
rising edge
0–
0
–
ns
t19
SR
Data float after RD
1
–
17.25 + tF
–
2TCL - 14 + tF
ns
t22
CC
Data valid to WR
11.25 + tC
–
2TCL - 20 + tC
–ns
t23
CC
Data hold after WR
17.25 + tF
–
2TCL - 14 + tF
–ns
t25
CC
ALE rising edge after RD, WR
17.25 + tF
–
2TCL - 14 + tF
–ns
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