参数资料
型号: TMP89FH42UG
元件分类: 微控制器/微处理器
英文描述: 8-BIT, FLASH, 10 MHz, MICROCONTROLLER, PQFP44
封装: 10 X 10 MM, 0.80 MM PITCH, LEAD FREE, PLASTIC, LQFP-44
文件页数: 128/317页
文件大小: 6434K
代理商: TMP89FH42UG
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(Example) Operate TC00 in the 8-bit PPG mode with the operation clock of fcgck/2 and output the 8μs duty pulse in
32μs cycles (fcgck = 10 MHz)
SET
(P7FC).0
; Sets P7FC0 to "1"
SET
(P7CR).0
; Sets P7CR0 to "1"
LD
(POFFCR0),0x10
; Sets TC001EN to "1"
DI
; Sets the interrupt master enable flag to "disable"
SET
(EIRH).4
; Sets the INTTC00 interrupt enable register to "1"
EI
; Sets the interrupt master enable flag to "enable"
LD
(T00MOD),0xF3
; Selects the 8-bit PPG mode and fcgck/2
LD
(T00REG),0xA0
; Sets the timer register (cycle)
; 32μs / (2/fcgck) = 0xA0
LD
(T00PWM),0x28
; Sets the timer register (duty pulse)
; 8μs / (2/fcgck) = 0x28
SET
(T001CR).0
; Starts TC00
Source clock
Counter
Timer start
1
0
m
(Duty pulse)
p
(1 cycle)
s
(1 cycle)
s
(1 cycle)
w
(1 cycle)
rt
rs
Write to T00PWM
Double buffer
Match detection
Write m
Write r
Write t
Becomes the level selected at
TFF0 while the timer is stopped
Returns to the
level selected
at TFF0
INTTC00 interrupt
request
1
m+1
m0
T00PWM
T001CR<T00RUN>
ps
w
Write to T00REG
Double buffer
Write p
Write s
Write w
p
Timer stop
Match detection
r+1
r
1
0
s
r+1
r
1
0
s
t+1
t
1
00
w
Match detection
Counter
clear
Counter
clear
Counter
clear
Counter
clear
T00MOD<TFF0>
PPG0 pin output
When the double buffer is enabled (T00MOD<DBE0>=”1”)
r
(Duty pulse)
r
(Duty pulse)
t
(Duty pulse)
ps
w
T00REG
Match detection
Figure 14-9 8-bit PPG Mode Timing Chart
TMP89FH42
Page 197
RA004
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PDF描述
TMP91FW60FG MICROCONTROLLER, PQFP100
TMPG06-24A-4 400 W, UNIDIRECTIONAL, SILICON, TVS DIODE
TMPG06-8.2A-23 400 W, UNIDIRECTIONAL, SILICON, TVS DIODE
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