参数资料
型号: TMP89FH42UG
元件分类: 微控制器/微处理器
英文描述: 8-BIT, FLASH, 10 MHz, MICROCONTROLLER, PQFP44
封装: 10 X 10 MM, 0.80 MM PITCH, LEAD FREE, PLASTIC, LQFP-44
文件页数: 230/317页
文件大小: 6434K
代理商: TMP89FH42UG
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lost". A master device which loses arbitration releases the SDA pin and the SCL pin in order not to effect data
transmitted from other masters with arbitration. When more than one master sends the same data at the first word,
arbitration occurs continuously after the second word.
ab
SCL (Bus)
SDA pin (Master 1)
SDA pin (Master 2)
SDA (Bus)
The SDA pin becomes "1" after losing arbitration.
Figure 18-12 Arbitration Lost
The serial bus interface circuit compares levels of a SDA line of a bus with its SDA pin at the rising edge of
the SCL line. If the levels are unmatched, arbitration is lost and SBI0SR2<AL> is set to "1".
When SBI0SR2<AL> is set to "1", SBI0CR2<MST> and SBI0CR2<TRX> are cleared to "0" and the mode
is switched to a slave receiver mode. Thus, the serial bus interface circuit stops output of clock pulses during data
transfer after the SBI0SR2<AL> is set to "1". After the data transfer is completed, SBICR2<PIN> is cleared to
"0" and the SCL pin is pulled down to the low level.
SBI0SR2<AL> is cleared to "0" by writing data to the SBI0DBR, reading data from the SBI0DBR or writing
data to the SBI0CR2.
SCL pin
SDA pin
SCL pin
SDA pin
SBI0SR2<AL>
SBI0CR2<MST>
SBI0CR2<TRX>
SBI0CR2<PIN>
INTSBI0 Interrupt request
Access to SBI0DBR
or SBI0CR2
D4A
123
456789
12
3456789
Master A
Master B
Stop clock output
Releasing SDA pin and SCL pin
to high level as losing arbitration.
D5A
D6A
D7A
D3A D2A D1A D0A
D6A
D7A
D5A’
D6A’
D7A’
Figure 18-13 Example When Master B is a Serial Bus Interface Circuit
TMP89FH42
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RA002
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PDF描述
TMP91FW60FG MICROCONTROLLER, PQFP100
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