- 您现在的位置：买卖IC网 > PDF目录300033 > TMP89FH42UG 8-BIT, FLASH, 10 MHz, MICROCONTROLLER, PQFP44 PDF资料下载
参数资料
| 型号： | TMP89FH42UG |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 10 MHz, MICROCONTROLLER, PQFP44 |
| 封装： | 10 X 10 MM, 0.80 MM PITCH, LEAD FREE, PLASTIC, LQFP-44 |
| 文件页数： | 227/317页 |
| 文件大小： | 6434K |
| 代理商： | TMP89FH42UG |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页第202页第203页第204页第205页第206页第207页第208页第209页第210页第211页第212页第213页第214页第215页第216页第217页第218页第219页第220页第221页第222页第223页第224页第225页第226页当前第227页第228页第229页第230页第231页第232页第233页第234页第235页第236页第237页第238页第239页第240页第241页第242页第243页第244页第245页第246页第247页第248页第249页第250页第251页第252页第253页第254页第255页第256页第257页第258页第259页第260页第261页第262页第263页第264页第265页第266页第267页第268页第269页第270页第271页第272页第273页第274页第275页第276页第277页第278页第279页第280页第281页第282页第283页第284页第285页第286页第287页第288页第289页第290页第291页第292页第293页第294页第295页第296页第297页第298页第299页第300页第301页第302页第303页第304页第305页第306页第307页第308页第309页第310页第311页第312页第313页第314页第315页第316页第317页
As Master 1 pulls down the SCL pin to the low level at point "a", the SCL line of the bus becomes the low
level. After detecting this situation, Master 2 resets counting a clock pulse in the high level and sets the SCL
pin to the low level.
Master 1 finishes counting a clock pulse in the low level at point "b" and sets the SCL pin to the high level.
Since Master 2 holds the SCL line of the bus at the low level, Master 1 waits for counting a clock pulse in
the high level. After Master 2 sets a clock pulse to the high level at point "c" and detects the SCL line of the
bus at the high level, Master 1 starts counting a clock pulse in the high level. Then, the master, which has
finished the counting a clock pulse in the high level, pulls down the SCL pin to the low level.
The clock pulse on the bus is determined by the master device with the shortest high-level period and the
master device with the longest low-level period from among those master devices connected to the bus.
18.4.5
Master/slave selection
To set a master device, SBI0CR2<MST> should be set to "1".
To set a slave device, SBI0CR2<MST> should be cleared to "0". When a stop condition on the bus or an
arbitration lost is detected, SBI0CR2<MST> is cleared to "0" by the hardware.
18.4.6
Transmitter/receiver selection
To set the device as a transmitter, SBI0CR2<TRX> should be set to "1". To set the device as a receiver,
SBI0CR2<TRX> should be cleared to "0".
For the I2C bus data transfer in the slave mode, SBI0CR2<TRX> is set to "1" by the hardware if the direction
bit (R/W) sent from the master device is "1", and is cleared to "0" if the bit is "0".
In the master mode, after an acknowledge signal is returned from the slave device, SBI0CR2<TRX> is cleared
to "0" by hardware if a transmitted direction bit is "1", and is set to "1" by hardware if it is "0". When an
acknowledge signal is not returned, the current condition is maintained.
When a stop condition on the bus or an arbitration lost is detected, SBI0CR2<TRX> is cleared to "0" by the
hardware. Table 18-3 shows SBI0CR2<TRX> changing conditions in each mode and SBI0CR2<TRX> value
after changing.
Note:When SBI0CR1<NOACK> is "1", the slave address match detection and the GENERAL CALL detection
are disabled, and thus SBI0CR2<TRX> remains unchanged.
Table 18-3 SBI0CR1<TRX> Operation in Each Mode
Mode
Direction bit
Changing condition
TRX after changing
Slave mode
"0"
A received slave address is the
same as the value set to
I2C0AR<SA>
"0"
"1"
Master
mode
"0"
ACK signal is returned
"1"
"0"
When the serial bus interface circuit operates in the free data format, a slave address and a direction bit are not
recognized. They are handled as data just after generating the start condition. SBI0CR2<TRX> is not changed
by the hardware.
18.4.7
Start/stop condition generation
When SBI0SR2<BB> is "0", a slave address and a direction bit which are set to the SBI0DBR are output on
a bus after generating a start condition by writing "1" to SBI0CR2 <MST>, SBI0CR2<TRX>, SBI0CR2<BB>
and SBI0CR2<PIN>. It is necessary to set SBI0CR1<ACK> to "1" before generating the start condition.
TMP89FH42
18. Serial Bus Interface (SBI)
18.4 Functions
Page 286
RA002
相关PDF资料 |
PDF描述 |
|---|---|
| TMP91FW60FG | MICROCONTROLLER, PQFP100 |
| TMPG06-24A-4 | 400 W, UNIDIRECTIONAL, SILICON, TVS DIODE |
| TMPG06-8.2A-23 | 400 W, UNIDIRECTIONAL, SILICON, TVS DIODE |
| TMPZ5250LR | 20 V, SILICON, UNIDIRECTIONAL VOLTAGE REGULATOR DIODE, TO-236AB |
| TMPZ5233R | 6 V, SILICON, UNIDIRECTIONAL VOLTAGE REGULATOR DIODE, TO-236AA |
相关代理商/技术参数 |
参数描述 |
|---|---|
| TMP89FH42UG(JZ) | 制造商:Toshiba America Electronic Components 功能描述:MCU 8BIT 16384BYTES FLASH 44LQFP |
| TMP89FH46 | 制造商:TOSHIBA 制造商全称:Toshiba Semiconductor 功能描述:8 Bit Microcontroller |
| TMP89FH46DUG | 制造商:TOSHIBA 制造商全称:Toshiba Semiconductor 功能描述:Microcomputers / Microcomputer Development Systems |
| TMP89FH46LDUG | 制造商:TOSHIBA 制造商全称:Toshiba Semiconductor 功能描述:Microcomputers / Microcomputer Development Systems |
| TMP89FM40NG | 制造商:TOSHIBA 制造商全称:Toshiba Semiconductor 功能描述:Microcomputers / Microcomputer Development Systems |
发布紧急采购，3分钟左右您将得到回复。