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参数资料
| 型号： | W83L951DG |
| 厂商： | Nuvoton Technology Corporation of America |
| 文件页数： | 26/112页 |
| 文件大小： | 0K |
| 描述： | IC EMBEDDED CNTRLR 128-LQFP |
| 标准包装： | 90 |
| 系列： | W83 |
| 核心处理器： | 8051 |
| 芯体尺寸： | 8-位 |
| 速度： | 24MHz |
| 连通性： | 主机接口，PS/2，SMBus，UART/USART |
| 外围设备： | PWM，WDT |
| 输入/输出数： | 104 |
| 程序存储器容量： | 64KB（64K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 2K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 数据转换器： | A/D 8x10b; D/A 2x8b |
| 振荡器型： | 外部 |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 128-LQFP |
| 包装： | 托盘 |
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W83L951DG/W83L951FG
- 16 -
5.3
LPC Interface Part
LPC Interface is formed by LAD0~LAD3, SERIRQ, LRESET#, LFRAME#, LCLK and VCC2. These
pins are defined by LPC interface Spec except VCC2. Below are descriptions about all LPC pins:
Table 5-4 LPC interface pin configuration table
SYMBOL
PIN
I/O
FUNCTION
LCLK
51
Its
PCI clock input. Same 33MHz clock as PCI clock on the host.
Same clock phase with typical PCI skew.
LFRAME#
52
Its
Indicates start of a new cycle or termination of a broken cycle.
LRESET#
53
Its
Reset signal. It can connect to PCIRST# signal on the host.
SERIRQ
54
I/O24ts
Serial IRQ input/Output.
LAD0
56
I/O24ts
LAD[3..0] are multiplexed address, control, and data in LPC
bus.
LAD1
57
I/O24ts
LAD[3..0] are multiplexed address, control, and data in LPC
bus.
LAD2
58
I/O24ts
LAD[3..0] are multiplexed address, control, and data in LPC
bus.
LAD3
59
I/O24ts
LAD[3..0] are multiplexed address, control, and data in LPC
bus.
Note:
Other pins about LPC interface, CLKRUN#: Please see “GP4” part.VCC2: Please see “power & clock” part.
5.4
GPIO0 Part
This part contains:
General Purpose I/O Function
Default is General Purpose I/O. Change the value of GPIO0 and GPIOD0 register to determine 8
input/output.
Keyboard Matrix Column Output
Use Chipctrl2 register bit 3 to enable {GP0, GP1, GP20~23} keyboard scan and GP3 key wakeup
interrupt function.
Internal Flash Access Interface
When TEST# and RESET# are both low, Internal Flash Access Interface is enabled and other
functions are disabled.
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