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参数资料
| 型号： | W83L951DG |
| 厂商： | Nuvoton Technology Corporation of America |
| 文件页数： | 67/112页 |
| 文件大小： | 0K |
| 描述： | IC EMBEDDED CNTRLR 128-LQFP |
| 标准包装： | 90 |
| 系列： | W83 |
| 核心处理器： | 8051 |
| 芯体尺寸： | 8-位 |
| 速度： | 24MHz |
| 连通性： | 主机接口，PS/2，SMBus，UART/USART |
| 外围设备： | PWM，WDT |
| 输入/输出数： | 104 |
| 程序存储器容量： | 64KB（64K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 2K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 数据转换器： | A/D 8x10b; D/A 2x8b |
| 振荡器型： | 外部 |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 128-LQFP |
| 包装： | 托盘 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页当前第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页
W83L951DG/W83L951FG
- 54 -
Table 6-12 Internal Interrupt Vector & Trigger Type Table
SOURCE
VECTOR ADDRESS
TRIGGER TYPE
Non-mask Interrupt
0x0003
Edge Trigger
LPC Power Fail Interrupt
0x000b
Edge Trigger
Input Buffer 0 Full Interrupt
0x0013
Edge Trigger
Output Buffer 0 Empty Interrupt
0x001b
Edge Trigger
Input Buffer 1 Full Interrupt
0x0023
Edge Trigger
Output Buffer 1 Empty Interrupt
0x002b
Edge Trigger
Timer 1 Interrupt
0x0033
Edge Trigger
Timer 2 Interrupt
0x003b
Edge Trigger
Timer X Interrupt
0x0043
Edge Trigger
Timer Y Interrupt
0x004b
Edge Trigger
External Interrupt Group 1
0x0053
Level Trigger
External Interrupt Group 2
0x005b
Level Trigger
External Interrupt Group 3
0x0063
Level Trigger
Key Interrupt
0x006b
Edge Trigger
Real Time Clock Alarm Interrupt
0x0073
Edge Trigger
ADC Interrupt
0x007b
Edge Trigger
CNTR0 Interrupt
0x0083
Edge Trigger
CNTR1 Interrupt
0x008b
Edge Trigger
SMBUS 1 Interrupt
0x0093
Level Trigger
SMBUS 2 Interrupt
0x009b
Level Trigger
Keyboard PS2 Interrupt
0x00a3
Edge Trigger
Mouse PS2 Interrupt
0x00ab
Edge Trigger
Auxiliary PS2 Interrupt
0x00b3
Edge Trigger
CIR Interrupt
0x00bb
Edge Trigger
FAN 1 Interrupt
0x00c3
Level Trigger
FAN 2 Interrupt
0x00cb
Level Trigger
UART Tx Interrupt
0x00d3
Edge Trigger
UART Rx Interrupt
0x00db
Edge Trigger
Reserved
0x00e3
N/A
Reserved
0x00eb
N/A
Reserved
0x00f3
N/A
Reserved
0x00fb
N/A
6.5.1
Register Description
6.5.1.1
Interrupt Enable 1 Register (IE1) (Default Value: 0000_0000)
1: Enable. It produces Interrupt Request to Micro-Processor that Interrupt will be produced, and write
down in Interrupt Request 1 Register.
0: Disable. It does not produce Interrupt Request to Micro-Processor that Interrupt will be produced,
but write down in Interrupt Request 1 Register.
6.5.1.2
Interrupt Enable 2 Register (IE2) (Default Value: 0000_0000)
1: Enable. It produces Interrupt Request to Micro-Processor that Interrupt will be produced, and write
down in Interrupt Request 2 Register.
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