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参数资料
| 型号： | W83L951DG |
| 厂商： | Nuvoton Technology Corporation of America |
| 文件页数： | 90/112页 |
| 文件大小： | 0K |
| 描述： | IC EMBEDDED CNTRLR 128-LQFP |
| 标准包装： | 90 |
| 系列： | W83 |
| 核心处理器： | 8051 |
| 芯体尺寸： | 8-位 |
| 速度： | 24MHz |
| 连通性： | 主机接口，PS/2，SMBus，UART/USART |
| 外围设备： | PWM，WDT |
| 输入/输出数： | 104 |
| 程序存储器容量： | 64KB（64K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 2K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 数据转换器： | A/D 8x10b; D/A 2x8b |
| 振荡器型： | 外部 |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 128-LQFP |
| 包装： | 托盘 |
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W83L951DG/W83L951FG
Publication Release Date: August 2006
- 75 -
Revision 1.0
6.11 Consumer Infrared Communications Receiver Block
The CIrCC implements hardware-level decoding for the NEC Consumer IR Remote Control format.
The hardware decoder may be used to generate a wake-up event or to send parts of the received
message frame to the FIFO. The No Care Custom Code (NCCC), No Care Data Code (NCDC), PME
Wake and Frame bits of the Consumer IR Control register configure the hardware decoder.
About NEC Consumer IR Format, the NEC Consumer IR Remote Control format specifies a 38 kHz
carrier, 13ms of sync framing, and 32 bits of pulse-position modulated (PPM) message data. The
message data includes an 8 bit Custom Code field, an 8 bit Custom Code’ field, an 8 bit Data Code
field, and an 8 bit Data Code’ field. A single frame of the NEC PPM Consumer Remote Control signal
is shown in Figure 14-1.
The Custom Code fields in this protocol uniquely address message frames for specific devices. The
Custom Code fields can be used as a 16 bit address or as an 8 bit address followed by the bit-wise
complement of the Custom Code field Custom Code. The Data Code field is an 8 bit command code,
Data Code’ is the bit-wise complement of Data Code.
Note: The CIrCC hardware can decode NEC protocol framing (sync pulse, 32 bit PPM message data)
at any data rate, depending on the programmed Bit Rate Divider (BRD).
Table 6-19.Consumer Infrared Communications Receiver Register Define
CIR BLOCK(3)
EXTADDR
NAME
7
6
5
4
3
2
1
0
40
CIRCON
DFE
SFE
REP
FINISH
DM
SM
RM
RXINV
41
CIRBRD
Baud Rate Divider[7:0]
42
CIRDATA1
CIR Receive Data 1[7:0]
43
CIRDATA2
CIR Receive Data 2[7:0]
44
CIRDATA3
CIR Receive Data 3[7:0]
45
CIRDATA4
CIR Receive Data 4[7:0]
Gray: Only with System Reset to initial.
6.11.1 Register Description
6.11.1.1
CIR Configure Register (CIRCON) (Default Value: 0000_0000)
Bit 7: Data Frame Error Status Flag (Write ‘HIGH’ to Clear)
When Data Frame Error flag occurs, CIR Interrupt is generated. Write the bit can clear Data Frame
Error Flag.
Read:
0 - No error
1 - Data frame Error
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