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参数资料
| 型号： | WBLXT9785HCD0 |
| 厂商： | CORTINA SYSTEMS INC |
| 元件分类： | 网络接口 |
| 英文描述： | DATACOM, INTERFACE CIRCUIT, PQFP208 |
| 封装： | ROHS COMPLIANT, PLASTIC, HQFP-208 |
| 文件页数： | 14/234页 |
| 文件大小： | 3982K |
| 代理商： | WBLXT9785HCD0 |
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LXT9785 and LXT9785E Advanced 8-Port 10/100 Mbps PHY Transceivers
110
Datasheet
Document Number: 249241
Revision Number: 010
Revision Date: 30-May-2006
MDC
P4
I, ST, ID
Management Data Clock.
Clock for the MDIO serial data channel. Maximum
frequency is 20 MHz. Only MDC0 is used when 1x8 port
sectionalization is selected.
In 2x4 port sectionalization
mode, MDC0 clocks ports 0-3 register accesses and MDC1
clocks ports 4-7 register accesses. Refer to Figure 21 on
Network Interface Signal Description
TPOP0, TPON0
TPOP1, TPON1
TPOP2, TPON2
TPOP3, TPON3
TPOP4, TPON4
TPOP5, TPON5
TPOP6, TPON6
TPOP7, TPON7
P13, N13,
N14, P14,
K13, K14,
J14, J13,
F14, F13,
E13, E14,
B14, A14,
A13, B13
AO/AI
Twisted-Pair Outputs2, Positive & Negative, Ports 0-7.
During 100BASE-TX or 10BASE-T operation, TPO pins
drive 802.3 compliant pulses onto the line.
TPIP0, TPIN0
TPIP1, TPIN1
TPIP2, TPIN2
TPIP3, TPIN3
TPIP4, TPIN4
TPIP5, TPIN5
TPIP6, TPIN6
TPIP7, TPIN7
P12, N12,
M14, M13,
L13, L14,
H14, H13,
G14, G13,
D13, D14,
C14, C13,
A12, B12
AI/AO
Twisted-Pair Inputs3, Positive & Negative, Ports 0-7.
During 100BASE-TX or 10BASE-T operation, TPI pins
receive differential 100BASE-TX or 10BASE-T signals from
the line.
JTAG Test Signal Description
TDI
C12
I, ST, IP
Test Data Input.
Test data sampled with respect to the rising edge of TCK.
TDO
C11
O, TS
Test Data Output.
Test data driven with respect to the falling edge of TCK.
TMS
B11
I, ST, IP
Test Mode Select.
TCK
A11
I, ST, ID
Test Clock.
Clock input for JTAG test.
TRST_L
A10
I, ST, IP
Test Reset.
Reset input for JTAG test.
Miscellaneous Signal Description
Table 39. Intel
LXT9785 BGA15 Signal Descriptions (Sheet 3 of 7)
Symbol
BGA15 Ball
Designation
Type
Signal Description
1. Type Column Coding: I = Input, O = Output, OD = Open Drain output, ST = Schmitt Triggered input, TS =
Three-State-able output, SL = Slew-rate Limited output, IP = weak Internal Pull-up, ID = weak Internal pull-
Down.
相关PDF资料 |
PDF描述 |
|---|---|
| WBLXT9785HEC2V | DATACOM, INTERFACE CIRCUIT, PQFP208 |
| WBLXT9785HED0 | DATACOM, INTERFACE CIRCUIT, PQFP208 |
| WE128K16-150CM | 128K X 16 EEPROM 5V MODULE, 150 ns, CDMA40 |
| WE128K16-150CQA | 128K X 16 EEPROM 5V MODULE, 150 ns, CDMA40 |
| WE128K16-250CC | 128K X 16 EEPROM 5V MODULE, 250 ns, CDMA40 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| WBLXT9785HE.D0-865114 | 制造商:Cortina Systems Inc 功能描述:PHY 8-CH 10Mbps/100Mbps 208-Pin PQFP |
| WBM-DATA | 制造商:Thomas & Betts 功能描述: |
| WBM-DISHWASH | 制造商:Thomas & Betts 功能描述: |
| WBM-DISPOSAL | 制造商:Thomas & Betts 功能描述: |
| WBM-DUPLEX | 制造商:Thomas & Betts 功能描述: |
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